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谁能帮忙看下这个verilog语法代表什么意思?
u010468899
2017-07-23 01:23:57
最近在看《基于FPGA的图像处理原理及应用》,
在某一章看到了如下一个语句:
assign din_temp[j] = din[DW_PER_FIFO*(j+1)-1-:DW_PER_FIFO] ;
这里的“din[DW_PER_FIFO*(j+1)
-1-:
DW_PER_FIFO]” 是个什么表达形式?
“-1-:” 这是什么鬼,代表什么意思呢?以前从来没有遇到过。
哪位高手能帮忙解答下,谢谢。
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谁能帮忙看下这个verilog语法代表什么意思?
最近在看《基于FPGA的图像处理原理及应用》, 在某一章看到了如下一个语句: assign din_temp[j] = din[DW_PER_FIFO*(j+1)-1-:DW_PER_FIFO] ; 这里的“din[DW_PER_FIFO*(j+1)-1-:DW_PER_FIFO]” 是个什么表达形式? “-1-:” 这是什么鬼,代表什么意思呢?以前从来没有遇到过。 哪位高手能帮忙解答下,谢谢。
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hsusea
2017-08-21
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DW_PER_FIFO代表的位宽,1后的-号代表从本位往下数DW_PER_FIFO个数。 例如DW_PER_FIFO为8,当j=1时,din[DW_PER_FIFO*(j+1)-1-:DW_PER_FIFO]为din[8*(1+1)-1-:8],进一步化简din[15:8] 例如DW_PER_FIFO为4,当j=0时,din[DW_PER_FIFO*(j+1)-1-:DW_PER_FIFO]为din[4*(0+1)-1-:4],进一步化简din[3:0]
snowgirl02
2017-07-25
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din的位宽截取的一种写法,从DW_PER_FIFO*(j+1)-1位截取DW_PER_FIFO位,低位放弃。
江鸟的坚持
2017-07-24
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这个编译已经通过了是吧,后面我估计是减1再减。。。吧
工具篇:在FPGA开发
Verilog
/System
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Sublime Text是一款流行的文本编辑器,可以用于
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和System
Verilog
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语法
设置非常重要,可以提高代码的可读性和编写效率。本文将介绍在开发
Verilog
和System
Verilog
...
verilog
语法
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verilog
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