DSP并行引导（多篇论文）下载

weixin_39821228 2019-06-10 09:30:15

DSP并行引导（多篇论文）
TMS320VC5402的并行引导装载方案的研究与设计
TMS320C5402DSP并行8bit EPROM引导装载方法研究
DSP外挂FLASH的在系统编程及并行引导装载方法的研究
TMS320VC5402并行引导装载方案设计
TMS320C54X的加载引导
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研究论文-基于闪存的DSP在线编程及并行引导方法研究

为了满足星载遥感图像压缩的实时性需求，以及最大程度地发挥硬件功效，提出了一种高效的JPEG2000星载遥感图像压缩实现方案。借助流水线和SPMD（Single Program Multiple Data）并行思想，建立了JPEG2000压缩算法实现方案的体系结构，并搭建了基于FPGA和4DSP的硬件平台。FPGA与4个DSP以独立方式通过EMIF接口相连，数据传输基于抢先式控制；为了便于对DSP调试和管理，4个DSP的仿真接口串成JTAG链结构；为了降低硬件复杂度以及加快DSP的引导速度，设计了HPI并行

数据加载策略FPGA由于其并行计算与高能效特点，用于CNN加速可以用较高的能效实现较低延迟提高性能；目前在FPGA上实现CNN加速器面临着许多问题：需要进行并行架构探索，内存带宽优化，时序面积优化和软硬件接口开发，时间开销大；这些特定网络加速器应用于其他网络是都必须重新配置FPGA；并且当网络更新时也必须同步更新RTL代码和编译；作者研究了通用的CNN加速器，采用FPGAoverlay技术FPGA硬件电路实现一旦固定不需要改变；

摘要：随着数字信号处理（DSP）技术的成熟以及芯片技术工艺的飞速发展，作为光传输领域中的关键技术之一，光数字信号处理在专用集成电路（ASIC）上的实现成为了研究重点。本文围绕着ASIC芯片中DSP算法设计流程中的主要步骤和常见问题，通过建立16QAM数字通信系统模型，对通信系统中各个模块中的信号进行建模与分析，采取了多次仿真实验对模型中关键参数之间的关系进行了对比与分析，根据仿真结果总结得出了在预设条件下较为适用的一套芯片相噪补偿算法，并实现了其在ASIC。

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