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CPLD实现DSP片外存储器扩展下载
weixin_39820780
2019-07-14 12:30:25
CPLD实现DSP片外存储器扩展 CPLD实现DSP片外存储器扩展
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CPLD
实现
DSP
片
外存储器
扩展
CPLD
实现
DSP
片
外存储器
扩展
CPLD
实现
DSP
片
外存储器
扩展
VC5402与外部存储器的接口设计
作为
DSP
芯
片
与外界交换数据的重要关口,外扩存储器接口的优劣程度直接影响着
DSP
的适应性和控制功能,同时,高性能、灵活性强的外部存储器接口也是利用
DSP
搭建图像采集处理系统的重要保证。基于上述原因,本文提出了一种基于
CPLD
的VC5402 存储器
扩展
方案,此方法具有接口灵活、调试方便的优点。
单
片
机与
DSP
中的基于
DSP
的运动控制器的研究与开发
摘要: 由于
DSP
将超强的高速实时处理能力和丰富的外设功能集于一身,目前,以
DSP
为核心的嵌入式运动控制器已经成为开放式运动控制器的发展主流,并获得广泛的应用。本文通过 对运动控制器基本功能的研究,在分析、消化已有的基于
DSP
的运动控制器硬件资源基础上,开发了运动控制器的软件系统,详细介绍了运动控制器的软件设计。 1 运动控制器硬件结构 本运动控制器的硬件结构主要分为如下几个模块:
DSP
+
CPLD
主控模块,包括
DSP
核心 模块和
CPLD
驱动与
扩展
模块;通信接口模块,包括 PCI 总线、USB 总线和串口;I/O 输入输 出接口模块以及外围存储器模块,包括 SRAM 和
基于
DSP
的声纳波束形成系统设计 (2006年)
由TMS320C6416的声纳波束形成系统,该系统包括波束形成板、信号处理板、音频处理板、控制底板。其中波束形成板是系统的核心,16路声信号先经过光电隔离,送入
DSP
进行运算。双端口存储器阵列存储波束形成的所有结果,并分配到各处理板,利用其双端口特点
实现
波束形成板和其他处理板之间的数据交换。逻辑控制电路由
CPLD
完成,主要完成整个处理单元的时序和逻辑控制。该系统具有可
扩展
、易于构成并行系统的特点,方便
实现
各种波束形成算法,具有一定的工程实用价值。
单
片
机与
DSP
中的采用PSD913F2
扩展
8031程序空间(图)
概述 8031系列单
片
机是应用非常广泛的MCU,但是随着控制领域的不断智能化、复杂化,程序长度可能远远大于8031的64KB限制。可以采用PSD913F2作为8031的外部存储器,其程序空间最大可达256KB,用KeilC51的BlankSwitch技术可使8位MCU运行256KB的应用程序。 PSD913F2内置256KB闪存,分为8个页面,每页空间16KB,内置可选的32KB启动存储器、2KB的SRAM、27个I/O端口、电源管理单元、40个可编程逻辑宏单元
CPLD
,通过串口在线配置FPGA所有代码,适用于8031、MC68HC11、Dallas、Z80等20余种单
片
机。 8031与
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