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一道笔试题,小弟学过数字逻辑,但是Verilog没学过,这是一道关于D触发器的题目,请各位大佬请教一下。
_Gorden_
2020-09-05 10:29:57
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一道笔试题,小弟学过数字逻辑,但是Verilog没学过,这是一道关于D触发器的题目,请各位大佬请教一下。
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壶中日月小
2020-09-07
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电路没问题,带锁存的串并转换,在串行时钟下,数据一位一位输入,串行输入不影响并行输出,相当于带锁存,在并行时钟下,并行数据才输出。
ylt9811115_1
2020-09-07
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这是串并转换吗?
luj_1768
2020-09-07
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题目没错吧?把电路搭好测试一下,不就解决了。
_Gorden_
2020-09-06
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看不懂啊...
zgl7903
2020-09-05
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