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分享VHDL与vc的问题（我已经问过一遍了，可是没有人理我）
我现在的工作是用C语言来翻译VHDL语言（姑且先这么说吧），就是可以使用C++语言来进行可以用硬件实现的算法的描述。VHDL语言中有一些专用的数据类型是C语言所没有的，所以第一部先在
C++语言中定义一些新的数据类型。
VHDL语言中有如下描述7值逻辑的数据类型：
TYPE std_ulogic IS ( 'U', -- Uninitialized
'X', -- Forcing Unknown
'0', -- Forcing 0
'1', -- Forcing 1
'Z', -- High Impedance
'W', -- Weak Unknown
'L', -- Weak 0
'H', -- Weak 1
'-' -- Don't care
);
-------------------------------------------------------------------
-- unconstrained array of std_ulogic for use with the resolution function
-------------------------------------------------------------------
TYPE std_ulogic_vector IS ARRAY ( NATURAL RANGE <> ) OF std_ulogic;
-------------------------------------------------------------------
-- resolution function
-------------------------------------------------------------------
FUNCTION resolved ( s : std_ulogic_vector ) RETURN std_ulogic;
-------------------------------------------------------------------
-- *** industry standard logic type ***
-------------------------------------------------------------------
SUBTYPE std_logic IS resolved std_ulogic;
-------------------------------------------------------------------
-- unconstrained array of std_logic for use in declaring signal arrays
-------------------------------------------------------------------
TYPE std_logic_vector IS ARRAY ( NATURAL RANGE <>) OF std_logic;
都是高级语言，看懂上面这一段VHDL语言的描述应该不困难，其resolved是一个函数。
想请教各位有没有好的建议，在C++中如何定义这几个数据类型比较合适？
C++语言中定义一些新的数据类型。
VHDL语言中有如下描述7值逻辑的数据类型：
TYPE std_ulogic IS ( 'U', -- Uninitialized
'X', -- Forcing Unknown
'0', -- Forcing 0
'1', -- Forcing 1
'Z', -- High Impedance
'W', -- Weak Unknown
'L', -- Weak 0
'H', -- Weak 1
'-' -- Don't care
);
-------------------------------------------------------------------
-- unconstrained array of std_ulogic for use with the resolution function
-------------------------------------------------------------------
TYPE std_ulogic_vector IS ARRAY ( NATURAL RANGE <> ) OF std_ulogic;
-------------------------------------------------------------------
-- resolution function
-------------------------------------------------------------------
FUNCTION resolved ( s : std_ulogic_vector ) RETURN std_ulogic;
-------------------------------------------------------------------
-- *** industry standard logic type ***
-------------------------------------------------------------------
SUBTYPE std_logic IS resolved std_ulogic;
-------------------------------------------------------------------
-- unconstrained array of std_logic for use in declaring signal arrays
-------------------------------------------------------------------
TYPE std_logic_vector IS ARRAY ( NATURAL RANGE <>) OF std_logic;
都是高级语言，看懂上面这一段VHDL语言的描述应该不困难，其resolved是一个函数。
想请教各位有没有好的建议，在C++中如何定义这几个数据类型比较合适？
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scicos 2001-07-23
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help me
seedundersnow 2001-07-23
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要是做仿真器就更牛B拉~~~~~~~~~
seedundersnow 2001-07-23
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难道是要做VHDL的编译器? 好牛B啊!
hitwd2000 2001-07-23
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工业测量方面的我不懂
red_eyes 2001-07-23
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不是没有人理你，而是看了也不明白说的是什么东西
wjyasd 2001-07-23
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搞硬件的才回有机会接触VHDL。要是纯软件的话很少。
还是到 c/c++中去看看吧#
还是到 c/c++中去看看吧#
