关于UltraEdit的使用问题

jornor 2008-01-01 11:36:13

近日由于系统重装,我的UltraEdit内显示中文的时候只显示小方块.我试了许多方法都未解决,请教各位高手有没有方法啊?具体截图如下:

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paradise7th 2008-01-12

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字符集的问题,选择高级,设置代码页/地区

MavenTalk 2008-01-12

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楼上说的对的

火龙果被占用了 2008-01-10

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没用过UltraEdit，帮你顶顶吧。

goodmrning 2008-01-09

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帮楼主顶下

文档全面描述了Ultraedit使用方法，包括Ultraedit各种文档编辑功能、常用功能等

UltraEdit 使用的verilog 和systemverilog 代码加亮文件将附件覆盖UltraEdit安装文件的目录即可

来源： http://www.cppblog.com/tuuzed/archive/2008/12/27/70516.html 最近在研究Lua脚本语言（个人觉得它是Basic、C、C++的结合体），可是“强大”的UltraEdit默认安装后是不支持Lua语法高亮显示的，满屏幕“黑黑”的鸡肠字符让人感觉编程是那么的索然无味，没有了灵感。终于有一天GOOGLE了一下，发现了很多解决办法，最好的办法就是：先去UltraEdit的官网下载支持Lua的Wordfiles文件(这里),是个文本文件（lua.txt）。打开UltraEdit安装目录下的wordfile.txt，把lua.txt文件中的内容拷贝粘贴到wordfile.txt的末尾，存盘，OK，于是UltraEdit语法高亮项多出Lua一项，可以选择使用了。比起网上说的02年版的lua.txt，这个04版（也是很旧）已经完美支持“注释块”和“注释行”高亮了，所以无需在改它的第一行。但是，使用一段时间后，还是发现有问题，比如：有部分关键字没有加亮（如：os，pair, ipair等）；不支持代码折叠（不能很好地知道结束关键字end是属于哪个while、for、function等）；对UltraEdit的F8（函数列表）功能支持得不完美。还好，看了UltraEdit帮助后，自己修改了一下，解决了上述问题，下面就贴出我的lua.txt（在这里下载修改后的Lua.txt）。

硬件开发时，常用verilog HDL 硬件描述语言来编写CPLD或是FPGA的逻辑程序，但各芯片厂商提供的verilog编辑器不仅外观丑陋，而且使用起来非常不灵活，有的甚至无法自动缩进。忍无可忍，只好自己动手，丰衣足食。还好有Ultraedit这么一个强大的编辑器软件，可以DIY一个语法环境出来，网上找到的verilog语言wordfile都不是很全，最要命的是不能生成函数(模块)列表，自动配对、缩进也没做全。花了半天时间，学习了一下所谓的“正则表达式”，终于生成了我希望的完整列表。最后说一下，这个wordfile使用时要注意的地方： 1.有的内部module的端口列表比较长，为了可以像函数一下展开和收起，定义了“（+制表符”和“）；”是一对可收起的标示符，因此在其他地方的“）；”最好在中间插个空格。 2.设置了多级列表， module parameter input port output port ioput port wire reg always block assign lines submodule port 3.文件时*.uew格式，在UE19里可以直接用，其他早前版本，可以用文本文件打开，拷贝到wordfile文件里去。 4.使用中有什么问题，欢迎加QQ（2245240164，请注明verilog），乐意分享和交流

使用ultraedit批量删除代码中的注释，网上找了许多，没有能直接用的，以前没写过正则表达式，废了九牛二虎的力气，总算是写出来了，呵呵~分享一下！

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