求www.oracle.com.cn 邀请码

feifeixia2008 2009-03-16 12:34:54
求www.oracle.com.cn 邀请码
谢谢先哈!~

fei.zhao@centralsoft.com.cn
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latnokxss 2009-08-07
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也给我一个racle.COM.CN的邀请码吧,万分感谢!
xiashi@yeah.net
又是违规昵称 2009-03-16
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[Quote=引用 1 楼 BrainStormLee 的回复:]
飞来接客啦!!!

又有人要邀请码....
[/Quote]

接客??

昏~~~~~~~~~~~

feifeixia2008 2009-03-16
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哈哈,这段时间需要看看oracle方面资料,想去论坛看看,学习学习,
feifeixia2008 2009-03-16
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哈哈,这段时间需要看看oracle方面资料,想去论坛看看,学习学习,
BrainStormLee 2009-03-16
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来接客啦!!!

又有人要邀请码....
superhsj 2009-03-16
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这是那个论坛的某位版主的msn
MSN: wt66550601@hotmail.com
从一个置顶帖子里找到的,那个帖子说需要邀请码的可以直接找他要
代码转载自:https://pan.quark.cn/s/a4b39357ea24 基于VHDL语言的24进制多功能数字钟 FPGA多功能数字钟设计 安装要 本项目采用QuartusII9.0版本设计,非9.0版本打开可能会存在兼容性问题。 本项目选用FPGA器件为CycloneIII_EP3C40Q240C8 设计任务 设计一个24进制多功能数字电子钟,要具备以下功能: (1)时钟显示:能够以十进制在7段数码管上显示“时”、“分”、“秒”、“十分之一秒”。 (2)校表功能:能够对时钟进行校正。 (3)启动/暂停功能:能够控制时钟的启动和暂停。 (4)一键清零功能:能够将时钟清零。 (5)整点报时功能:能够在整点时发出报时信号。 (6)闹钟功能:能够在设置的时间到达时发出闹钟信号。 顶层设计原理图如下: image 设计方案/设计原理及总体框图 设计实现思路: (1)计时功能。 计时功能主要由四个计数器模块共同构成,其中十分之一秒计时器为十进制计数、分,秒计时器为六十进制计数、小时计时器为二十四进制计数。 计时器之间采用进位信号进行串联。 (2)十进制7端数码管显示功能。 显示功能由译码器模块实现。 译码器模块的两个输入端分别为刷新端和数据端。 七个译码器的刷新端连接十分之一秒的周期脉冲信号。 而数据端连接计数器的输出端,用以将4位输出BCD码译码为7端数码管的七位显示信号。 (3)校表功能。 校表功能由二选一模块和校时模式选择器模块构成。 其中二选一模块用于连接下一级计时器模块的进位信号和手动按钮脉冲信号。 当控制信号为“0”时,二选一模块输出计时器模块的进位信号。 而当控制信号为“1”时,二选一模块输出手动按钮信号。 控制信号由校时模式选择器模块输出,校时模式选择器输出端连...

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