VC2005 没有可用于当前位置的源代码

lengmozaixian 2009-04-13 12:11:01
运行程序设置断点(逐过程调试),执行完设置断点的函数返回调用函数,继续执行完后出现“没有可用于当前位置的源代码”对话框,这是怎么回事?整个程序若不设置断点时能正确运行下去。网上查过,可能的解决方法:“解决方案属性页”对话框 ->“通用属性”->“调试源文件”,可是没找到“调试源文件”这个选项,请高手指点。
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oneal198712 2010-09-02
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顶楼上的,我也遇到同样的问题,按照21楼方法搞定,感谢!
纪飞 Jackie 2009-05-22
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LZ,你说的那个方法 是对的,估计 你没找对地方,
不是:工程属性页。
方法:
1、切换到:解决方案资源管理器
2、在 解决方案‘******’ (*个项目) 上 ,右键,属性
3、出现的 解决方案“******”属性页
4、点:通用属性->调试源文件
5、把:不查找这些源文件 文本框里 的 内容 都去掉
6、OK.
qzl123666 2009-04-14
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很有可能是你的程序与源代码不对应。有可能是你改了源代码,而程序没有重新生成,建议重新生成一下。
还有你是不是调用其他程序来调试你的程序,如果是的话估计可能是没有调用到。

ckc 2009-04-14
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比如你的程序中有
printf(".....");
这样的语句,你是没办法调试的
因为你没有printf实现的源代码
ysysbaobei 2009-04-14
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我也遇到相同问题,顶下
liubuweiright 2009-04-13
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你一直按F10,会出来的
liubuweiright 2009-04-13
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学习
liliangbao 2009-04-13
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[Quote=引用 1 楼 arong1234 的回复:]
是不是你试图返回系统库部分?源码只有你自己写的部分必然是可以返回的,如果属于系统代码,不一定可以调试
[/Quote]
Up 查一查~
Paradin 2009-04-13
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会出汇编阿吧
fairchild811 2009-04-13
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系统的不能搞吧
arong1234 2009-04-13
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你试图返回的上一级函数是你自己的函数还是系统的代码?如果是后者,这很正常啊

[Quote=引用 12 楼 lengmozaixian 的回复:]
谢谢11楼,出现提示对话框后,按确定,再按F5,可进入下一函数中设的断点,但不知道是怎么回事,有的断点之间能连接按F10,进行执行,有的执行后出现提示框需要再按F5。
还有个问题请教:为什么有的地方不能设置断点,提示“当前不会命中断点。还没有为该文档加载任何符号”。
[/Quote]
mengde007 2009-04-13
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我只能说仔细检查了
ysysbaobei 2009-04-13
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lengmozaixian 2009-04-13
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谢谢11楼,出现提示对话框后,按确定,再按F5,可进入下一函数中设的断点,但不知道是怎么回事,有的断点之间能连接按F10,进行执行,有的执行后出现提示框需要再按F5。
还有个问题请教:为什么有的地方不能设置断点,提示“当前不会命中断点。还没有为该文档加载任何符号”。
yangshufengoo 2009-04-13
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DSW文件不能全部被导入.
「已注销」 2009-04-13
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检查一下pdb文件是否生成?
重编译一次后是否问题依旧?
Hayden_yang 2009-04-13
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up.系统代码,不一定可以调试
sagegz 2009-04-13
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[Quote=引用 1 楼 arong1234 的回复:]
是不是你试图返回系统库部分?源码只有你自己写的部分必然是可以返回的,如果属于系统代码,不一定可以调试
[/Quote]
up~!
arong1234 2009-04-13
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是不是你试图返回系统库部分?源码只有你自己写的部分必然是可以返回的,如果属于系统代码,不一定可以调试
Jalien 2009-04-13
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你一直按F10会到系统库里面去 不让访问 只能按F5了
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代码转载自:https://pan.quark.cn/s/a4b39357ea24 基于VHDL语言的24进制多功能数字钟 FPGA多功能数字钟设计 安装要求 本项目采用QuartusII9.0版本设计,非9.0版本打开可能会存在兼容性问题。 本项目选用FPGA器件为CycloneIII_EP3C40Q240C8 设计任务 设计一个24进制多功能数字电子钟,要求具备以下功能: (1)时钟显示:能够以十进制在7段数码管上显示“时”、“分”、“秒”、“十分之一秒”。 (2)校表功能:能够对时钟进行校正。 (3)启动/暂停功能:能够控制时钟的启动和暂停。 (4)一键清零功能:能够将时钟清零。 (5)整点报时功能:能够在整点时发出报时信号。 (6)闹钟功能:能够在设置的时间到达时发出闹钟信号。 顶层设计原理图如下: image 设计方案/设计原理及总体框图 设计实现思路: (1)计时功能。 计时功能主要由四个计数器模块共同构成,其中十分之一秒计时器为十进制计数、分,秒计时器为六十进制计数、小时计时器为二十四进制计数。 计时器之间采用进位信号进行串联。 (2)十进制7端数码管显示功能。 显示功能由译码器模块实现。 译码器模块的两个输入端分别为刷新端和数据端。 七个译码器的刷新端连接十分之一秒的周期脉冲信号。 而数据端连接计数器的输出端,用以将4位输出BCD码译码为7端数码管的七位显示信号。 (3)校表功能。 校表功能由二选一模块和校时模式选择器模块构成。 其中二选一模块用于连接下一级计时器模块的进位信号和手动按钮脉冲信号。 当控制信号为“0”时,二选一模块输出计时器模块的进位信号。 而当控制信号为“1”时,二选一模块输出手动按钮信号。 控制信号由校时模式选择器模块输出,校时模式选择器输出端连...

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