硬件设计
sd卡时钟线在调试中的一点理解（硬件）
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我也要 关注 + 加入社区这两天对一个2410的板子上sd卡做了一个底层硬件测试。
sd卡的数据读写会经常出现错误，而且错误的地方很固定。
后来查了很久，发现sdclk（时钟线）被示波器的探头一接触，读写立即就正常了。我的理解：示波器探头相当于对地电容。
依据这一情况，领导给了我一个意见：
1 在sdclk与3.3V电源之间连接一个电阻。
2 在sdclk与GND之间连接一个电容。
通过调试电容电阻的值，sd卡读写正常了。
我不清楚这是为什么，同事说在时钟是下降沿触发电路时，加一个“上拉”电阻就好使。可是原因说不出来。在此我也不太清楚，sd是否是下降沿触发。
如果假设是下降沿触发，根据我的理解，在此的电阻是为了在下降沿触发时，提供准确的对地电位。由于是下降沿有效，所以在捕捉到下降这一电平变化时
，sd卡就会根据命令线动作。然而由于噪声的影响，信号线的电平很容易受到干扰而降低，另sd卡产生误动作。所以加一个电阻上拉到高电位实际上就是为了令时钟信号有噪声干扰的时候，电位尽量不会发生偏移。
加一个对地电容的作用，在此是为了消除噪声。
红色字说得正确吗？如果有误，请大家指点！！！
sd卡的数据读写会经常出现错误，而且错误的地方很固定。
后来查了很久，发现sdclk（时钟线）被示波器的探头一接触，读写立即就正常了。我的理解：示波器探头相当于对地电容。
依据这一情况，领导给了我一个意见：
1 在sdclk与3.3V电源之间连接一个电阻。
2 在sdclk与GND之间连接一个电容。
通过调试电容电阻的值，sd卡读写正常了。
我不清楚这是为什么，同事说在时钟是下降沿触发电路时，加一个“上拉”电阻就好使。可是原因说不出来。在此我也不太清楚，sd是否是下降沿触发。
如果假设是下降沿触发，根据我的理解，在此的电阻是为了在下降沿触发时，提供准确的对地电位。由于是下降沿有效，所以在捕捉到下降这一电平变化时
，sd卡就会根据命令线动作。然而由于噪声的影响，信号线的电平很容易受到干扰而降低，另sd卡产生误动作。所以加一个电阻上拉到高电位实际上就是为了令时钟信号有噪声干扰的时候，电位尽量不会发生偏移。
加一个对地电容的作用，在此是为了消除噪声。
红色字说得正确吗？如果有误，请大家指点！！！
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