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一个关于奇偶校验位的问题
over300
2009-10-09 06:52:40
假设下列字符中有奇偶校验位.但没有数据错误,采用偶校验的字符码是()
A) 11001011 B)11010110 C)11000001 D)11001001
书中的答案是D
---选自(工业大学出版社 P32.22)
我查找了有关"奇偶校验位"的原理:
在原码加上一个校验位,它的码距等于2,能检验出一位错(或奇数位错),但不能确定出错位置,也不能测出偶数位错,有奇,偶两种校验.
但我实在不明白为什么是选择第4个,请会的热心人,能够帮忙指教,谢谢
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一个关于奇偶校验位的问题
假设下列字符中有奇偶校验位.但没有数据错误,采用偶校验的字符码是() A) 11001011 B)11010110 C)11000001 D)11001001 书中的答案是D ---选自(工业大学出版社 P32.22) 我查找了有关"奇偶校验位"的原理: 在原码加上一个校验位,它的码距等于2,能检验出一位错(或奇数位错),但不能确定出错位置,也不能测出偶数位错,有奇,偶两种校验. 但我实在不明白为什么是选择第4个,请会的热心人,能够帮忙指教,谢谢
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over300
2009-10-11
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好的,我已将您的解释抄下,拿回去,我再好好理解一下,谢谢
zentropy
2009-10-09
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偶校验:1的个数是偶数个
奇校验:1的个数是奇数个
数一数哪个1的个数是偶数就行了
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题意说能否使a串等于b串...a串的转换操作为: 1>在末
位
加上
奇偶校验
位
(偶数个1为0...奇数个为0) 2>去掉a的首
位
... 1,2操作可以多次进行... 可见...若a的1为偶数个...末尾可以加任意多的0...如果a的1为奇数个..在a后加1后..a的1又变成偶数个了..若想能再在a的末尾加1...只能去掉a前面的
一个
1... 所以...若a有k个1..可以通
【FPGA】Verilog:
奇偶校验
位
发生器 |
奇偶校验
位
校验器
奇偶校验
位
是用来检查数据传输过程中是否发生错误的
位
。
奇偶校验
位
用于检查数据传输过程中是否发生错误。它可以通过在整个数据
位
上增加
一个
位
来实现,通常在要传输的数据
位
较小且不太可能出错时使用。当要传输的数据量较小且出错概率较低时,就会使用
奇偶校验
位
。
奇偶校验
位
奇偶校验
位
奇偶校验
位
(parity bit)或校验比特(check bit)是
一个
表示给定
位
数的二进制数中1的个数是奇数还是偶数的二进制数。
奇偶校验
位
是最简单的错误检测检测码。
奇偶校验
位
有两种类型:偶校验
位
与奇校验
位
。 如果一组给定数据
位
中1的个数是奇数,那么偶校验
位
就置为1,从而使得1的个数是偶数。如果给定一组数据为
位
中1的个数是偶是,那么奇校验
位
就置为1,使得总的1的个数是奇数。 偶校验
位
...
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