用C语言按照软件工程的标准开发程序,一个模块具体是什么表现形式?

zyq_123 2011-02-02 05:50:39
就是说,一个模块是至少是由一个或以上函数组成,还是一个实现特定功能的代码段片段(即是没有封装在函数里面)就已经算是一个模块了?
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赵4老师 2011-02-07
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记不得哪位C++大牛在哪本学习C++的书的前言里面说过
“用C语言1000行源码能完成的工作千万不要用C++重写!”
偶也认为
“用C++1000行源码能完成的工作千万不要用软件工程!”
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学习下
zyq_123 2011-02-04
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软件结构图,有没有子图概念,就是一个子模块又能分出很多个子模块,那就再来一张子结构图,这样行不行?怎样处理比较合适!
super_admi 2011-02-03
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一般模块不是用代码来衡量的,而是用功能来衡量的。

实现一个完整功能的所有东西,称之为一个模块(我自己下的定义)。
muku9527 2011-02-03
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不是很了该,希望大牛详细介绍下
qq120848369 2011-02-02
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包含头文件,引入模块就能直接使用,这就是封装好的.

一段代码,拿过来不能直接使用,还需要用户添加东西或者引入其他模块支持,那就是没封装好.
iambic 2011-02-02
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一般是几个源文件组成的一个库。
zyq_123 2011-02-02
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一,模块是由实现特定功能的代码段,或函数组成的。
二,没有封装成函数的代码段不算是模块。

选择一,还是二?
C语言课程设计通讯录管理系统 文件编码(008-TTIG-UTITD-GKBTT-PUUTI-WYTUI-8256) 文件编码(008-TTIG-UTITD-GKBTT-PUUTI-WYTUI-8256) C语言课程设计通讯录管理系统全文共44页,当前为第1页。C语言课程设计通讯录管理系统 C语言课程设计通讯录管理系统全文共44页,当前为第1页。 ***科技大学 本科生课程设计说明书 题 目:C语言课程设计 —— 通讯录管理系统 学生姓名:** 学 号:*** 专 业:软件工程 班 级:1 C语言课程设计通讯录管理系统全文共44页,当前为第2页。指导教师:** C语言课程设计通讯录管理系统全文共44页,当前为第2页。 C语言课程设计通讯录管理系统全文共44页,当前为第3页。内蒙古科技大学课程设计任务书 C语言课程设计通讯录管理系统全文共44页,当前为第3页。 课程名称 C语言课程设计 设计题目 通讯录管理系统 指导教师 *** 时间 —— 一、教学要求 1. 巩固和加深学生对C语言课程的基本知识的理解和掌握2. 掌握C语言编程和程序调试的基本技能3. 利用C语言进行基本的软件设计4. 掌握书写程序设计说明文档的能力5. 提高运用C语言解决实际问题的能力 二、设计资料及参数 每个学生在教师提供的课程设计题目中任意选择一题,独立完成,题目选定后不可更换。 通讯录管理系统 现有一批通讯录的数椐,要求输入计算机并存放在内存中,然后增加若干个新通讯录的记录,并可输出通讯录清单,实现文件存盘和读入文件进行修改的功能。通讯录的基本信息包括编号,姓名,电话号码,QQ号码,电子邮件,通讯地址。要求设计菜单来调用其各功能模块: 新建文件、打开文件、保存信息到文件 输入记录、输出记录 查询记录(至少具有两种查询方式,例如以姓名查询和以电话号码查询) 修改、插入和删除记录 三、设计要求及成果 1. 分析课程设计题目的功能需求(可选用数组或链表实现,可多人(最多3人)协作完成一个题目)2. 写出详细设计说明(至少包括功能实现分析和模块流程图)3. 编写程序代码,调试程序使其能正确运行(代码书写要规范,标示符要见名知意,要有必要的注释,每人至少3个函数,每人至少200行代码,不包括注释和花括号)4. 设计完成的软件要便于操作和使用5. 设计完成后提交课程设计报告(请严格按照模板进行排版) 四、进度安排 第一天? 选择课程设计题目,分析课题的要求第二天? 编程第三天? 编程及调试第四天? 写课程设计报告第五天? 提交课程设计报告(打印稿及电子稿) 五、评分标准 1. 根据平时上机考勤、表现和进度,教师将每天点名和检查 2. 根据课程设计完成情况,必须有可运行的软件。3. 根据课程设计报告的质量,如有雷同,则所有雷同的所有人均判为不及格。 六、建议参考资料 1.《C语言程序设计》,谭浩强,清华大学出版社 C语言课程设计通讯录管理系统全文共44页,当前为第4页。2.《C语言程序设计课程设计》,刘振安,机械工业出版社。 C语言课程设计通讯录管理系统全文共44页,当前为第4页。 目 录 C语言课程设计通讯录管理系统全文共44页,当前为第5页。 C语言课程设计通讯录管理系统全文共44页,当前为第5页。 第一章 需求分析 引言 通过程序设计,达到理论与实际应用相结合,提高对信息管理系统的分析能力,能够根据实际应用,初步实现系统功能模块及算法的设计,通过编程基本实现信息管理系统。 任务概述 采用结构体的形式对数据进行输入输出。 可以对通讯录进行简单的排序,筛选,删除。 可以对任意信息就行修改。 可以把数据已文件的形式输入输出。 任意浏览信息。 数据描述 以所示的文本数据位初始数据进行简单操作,也可另行添加。 功能需求 实现以上功能需求。 性能需求 能够进行简单的数据处理。 具有对新信息处理打印打能力。 运行需求 C语言课程设计通讯录管理系统全文共44页,当前为第6页。输入个人信息时以例如按照"编号、姓名、年龄、电话号码 、通讯地址 、 电子邮箱"的顺序输入。 C语言课程设计通讯录管理系统全文共44页,当前为第6页。 输入时编号年龄、电话号码、通讯地址、电子邮箱以数字格式输入,输入姓名以文字输入。 以(Y/N)形式判断时,仅限N或者n为否,其他字符真。 进入排序功能后,要想见排序信息,到主菜单下见浏览信息功能。 任务计划 1.样例输入和输出 2.本通讯录管理程序,可以对数据进行输入输出,集排序,修改,打印,删除等功能。 下面以上述数据描述的数据为测试数据进行简单输入输出。 ——1.未排序前的信息 4).删除界面: 删除后,通讯录里的显示记录: 5).查询界面: 以姓名查询方式为例: 6).修改界面: 修改后,通讯录里的显示记录: 7).保存界面: C语言课程设计通讯录管
有点大,分为两部分(上和下),还有一个超星阅读器 第1章 EDA设计与Verilog HDL语言概述   1.1 EDA设计概述   1.1.1 EDA技术简介   1.1.2 EDA与传统电子系统设计方法   1.1.3 可编程逻辑器件对EDA技术的要求   1.2 Verilog HDL语言简介   1.2.1 硬件描述语言说明   1.2.2 Verilog HDL语言的历史   1.2.3 Verilog HDL语言的能力   1.2.4 Verilog HDL和VHDL语言的比较   1.2.5 Verilog HDL和C语言的比较   1.3 Verilog HDL语言的描述层次说明   1.3.1 Verilog HDL语言描述能力综述   1.3.2 系统级和算法级建模   1.3.3 RTL级建模   1.3.4 门级和开关级建模   1.4 基于Verilog HDL语言的CPLD/FPGA开发流程   1.5 Verilog HDL语言的可综合与仿真特性   1.5.1 VerilogHDL语句的可综合性说明   1.5.2 Verilog HDL语句的仿真特性说明   1.6 本章小结   1.7 思考题   第2章 Verilog HDL基础与开发平台操作指南   2.1 Verilog HDL程序开发的必备知识   2.1.1数字的表示形式   2.1.2常用术语解释   2.1.3 Verilog HDL程序的优劣判断指标   2.2 Verilog HDL程序设计模式   2.2.1 自顶向下的设计模式   2.2.2层次、模块化模式   2.2.3 IP核的重用   2.3 Xilinx Spartan 3E系列FPGA简介   2.3.1 Spartan 3E系列FPGA简介   2.3.2 Spartan 3E系列FPGA结构说明   2.4 ISE快速入门   2.4.1 ISE操作基础   2.4.2 新建工程   2.4.3 Verilog HDL代码的输入与功能仿真   2.4.4 Xilinx IP核的使用   2.4.5 用户约束输入   2.4.6 综合与实现   2.4.7 器件配置   2.5 ModelSim快速入门   2.5.1 ModelSim仿真软件的安装   2.5.2 在ModelSim中指定Xilinx的仿真库   2.5.3 ModelSim的基本操作   2.6 本章小结   2.7 思考题   第3章 Verilog HDL程序结构   3.1 程序模块说明   3.1.1 Verilog HDL模块的概念   3.1.2 模块的基本结构   3.1.3 端口说明   3.2 Verilog HDL的层次化设计   3.2.1 Verilog HDL层次化设计的表现形式   3.2.2 模块例化   3.2.3 参数映射   3.2.4 在ISE中通过图形化方式实现层次化设计   3.3 Verilog HDL语言的描述形式   3.3.1 结构描述形式   3.3.2 行为描述形式   3.3.3 混合设计模式   3.4 本章小结   3.5 思考题   第4章 Verilog HDL语言基本要素   4.1 标志符与注释   4.1.1 标志符   4.1.2 注释   4.2 数字与逻辑数值   4.2.1 逻辑数值   ……   第5章 面向综合的行为描述语句   第6章 面向验证和仿真的行为描述语句   第7章 系统任务和编译处理语句   第8章 Verilog HDL可综合设计的难点解析   第9章 高级逻辑设计思想与代码风格   第10章 可综合状态机开发实例   第11章 常用逻辑的Verilog HDL实现   第12章 Xilinx硬核模块的调用   第13章 串口接口的Verilog HDL设计   参考文献

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