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9528散分啦!!
wcjwdq
2011-07-20 10:42:25
第一次散分,哈哈~
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9528散分啦!!
第一次散分,哈哈~
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哎呦喂哈
2011-07-20
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5分额……
wcjwdq
2011-07-20
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[Quote=引用 2 楼 bigpretty 的回复:]
SFFFFFFFFFFFFFFFFF
[/Quote]破哥老发这个啊。。
wcjwdq
2011-07-20
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[Quote=引用 1 楼 sid2008 的回复:]
[/Quote]小鸟??
litianci2002
2011-07-20
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[Quote=引用 6 楼 mingjiezhou 的回复:]
没看错吧! 5分 ?
[/Quote]
。。。。。。。
zmj
2011-07-20
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没看错吧! 5分 ?
网站推广优化yetaoaiueo
2011-07-20
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散分散分。。
liushuo1987
2011-07-20
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别高兴了就5分
笨熊熊
2011-07-20
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才是5分啊。。
bigpretty
2011-07-20
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SFFFFFFFFFFFFFFFFF
笨熊熊
2011-07-20
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ad
9528
_setup()函数详解
完成AD
9528
参数配置后, 运行 ad
9528
_setup(..) 函数开始AD
9528
的配置。 ad
9528
_setup(..) 根据初始化配置中的参数,计算对应寄存器的值,并通过 SPI 将各个寄存器的值写入到AD
9528
芯片中,完成对AD
9528
芯片的配置。
ad9371 ad
9528
评估板手册,软件,代码等
https://www.analog.com/en/design-center/evaluation-hardware-and-software/evaluation-boards-kits/EVAL-AD
9528
.html#eb-overview https://github.com...
用microblaze搭配sdk配置AD
9528
芯片
AD
9528
是ADI(亚德诺半导体技术有限公司, Analog Devices, Inc. 简称ADI )出品的一款双级PLL,集成JESD204B SYSREF发生器,可用于多器件同步。 一级锁相环(PLL1):通过减少系统时钟的抖动,从而实现输入基准电压调理; 二级锁相环(PLL2):提供高频时钟,可实现来自时钟输出驱动器的较低积分抖动以及较低宽带噪声; 外部VCXO晶振(晶振频率范围:0~400MHz):提供PLL2所需的低噪声基准电压,以满足苛刻的相位噪声和抖动要求,实现可以接受的性能; 片
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9528
学习笔记
AD
9528
时钟芯片学习笔记
【FPGA开发】关于如何使用FPGA配置AD
9528
具体我们在项目中使用了,五路时钟,我们的配置要求如下所示:官网中有相应的可以下载的上位机软件,可以进行相应的配置,配置之后就可以知道相应的需要配置的寄存器参数是什么。这个是咨询厂家之后的基本配置方法,具体的配置原理,要详细的阅读datasheet,具体的就是OUT1 OUT2两个时钟需要使用从PLL2 divider中产生的时钟。
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