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关于数字信号驱动能力的问题
a318399949a
2011-08-30 04:49:44
问题:
现在做一个设备,要求检测其他设备输入过来的数字信号,但是这个信号比较弱,而且中间的数据线长1.3米左右
数字信号可能为SPI或者别的总线。
如何增强这些数据信号,硬件电路设计应该怎么考虑
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关于数字信号驱动能力的问题
问题: 现在做一个设备,要求检测其他设备输入过来的数字信号,但是这个信号比较弱,而且中间的数据线长1.3米左右 数字信号可能为SPI或者别的总线。 如何增强这些数据信号,硬件电路设计应该怎么考虑
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Simality
2011-08-31
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发送端和接收端都装74HC244/245这类总线收发器。发送端不允许的话就上数字信号放大器。
zhenghn2010
2011-08-31
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典型的信号采集系统, 看看经典的电路,都需要信号转换和放大吧,具体看你的需求
a318399949a
2011-08-31
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[Quote=引用 2 楼 f117c 的回复:]
把发送的信号放大传送
[/Quote]
主要是硬件设计上应该怎么做???
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2011-08-31
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做模拟的检测还是数字的检测?数字信号放大还是比较方便的。
Frankfu001
2011-08-31
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升高电压传送
Frankfu001
2011-08-31
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把发送的信号放大传送
DISINHUI
2011-08-31
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1.适当降低速录。
2.增加信号中继。
3.用屏蔽数据线。
piedgogo
2011-08-31
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同轴线特性阻抗为50欧或75欧姆;而常用非屏蔽双绞线的特性阻抗为100欧姆,屏蔽双绞线的特性阻抗为150欧姆。
在造的CMOS器件其输出阻抗都在40~80欧,取50欧居多。
【硬件工程师】关于信号电平
驱动
能力
驱动
能力
指输出端口的电流流入/流出大小,但大部分情况指输出端口的扇出
能力
。 扇出:一个输出端口连接多个输入端口。 从直流特性来讲 数字器件的输出端口有最大电流限制,超过电流限制,则有可能使输出电平幅度变低/烧毁器件。比方说,某单片机GPIO口高电平时的最大输出电流是20mA,那这个20mA规格就表征了该I/O口的电平
驱动
能力
。而如果负载过大(比如小电阻),则负载电流有可能超过其最大输出电流,这时我们说
驱动
能力
不足。
驱动
能力
不足的直接后果是输出电压下降,对逻辑电路来说,无法保持其高电平甚至会出现逻辑
数字电路中关于IO口
驱动
能力
的几个
问题
在电子设计中一些基本的
问题
需要我们掌握。今天看了上拉电阻和下拉电阻等讲到了关于
驱动
能力
,不太懂,于是谷歌了下,看到如下文章。 其中是关于
驱动
能力
的几个
问题
。直接进入主题吧。 1、问:为什么说
驱动
能力
不够是因为提供电流太小而不是电压?如何分析
驱动
能力
不够? 答:首先我们看到的
驱动
能力
不够大部分是在你选择的负载(电阻、喇叭等)电压符合供电电压的。那么电压符合了只要看电流大小是否足够。
关于
驱动
能力
不足的
问题
1、问:为什么说
驱动
能力
不够是因为提供电流太小而不是电压?和分析
驱动
能力
不够? 答:首先我们看到的
驱动
能力
不够大部分是在你选择的负载(电阻、喇叭等)电压符合供电电压的。那么电压符合了只有看电流大小是否足够。是电压还是电流引起
驱动
能力
不够,给你个判断方法,将后级电流开路测试电压是否符合负载电压。1符合但接上负载后电压就会降低这个就是电流
驱动
能力
不够。如果电压不够则是
驱动
电压不够。 ...
为什么插入buffer能够增加
驱动
能力
?
1 buffer是什么?所谓增加buffer,buffer一般是几级器件尺寸逐步增大的反相器或类似结构的电路,以使得电阻在获得所需的
驱动
能力
时,在功耗延时积上也达到最优。前后级的最佳
驱动
比例在2.718左右。buffer实际就是两个串联的反相器,常用于时钟路径中,用于增加时钟
驱动
能力
,使得时钟clock具有良好的上升沿和下降沿。时钟buffer本身是输入负载较小,输出
驱动
能力
较强。因此前级电路
驱动
...
驱动
能力
,带负载
能力
一般来说,所谓的
驱动
能力
指的是电流,一些芯片手册会给出
驱动
电流是多大。对于负载来说,接上下级负载后,电流没有超出前级
驱动
能力
则可以正常工作。 如果后级接上后,输入阻抗比较大(即后级这个负载大),同时还要求输入电流比较大,一般不会有这种芯片,不会有这样设计,因为本身就是矛盾的这样。 所谓的带负载
能力
强,电流
驱动
能力
大,
驱动
能力
强,这里的强或者说
驱动
能力
大小由它本身这款芯片(或系统)手册上给出的值决定。 (后级系统)负载越大,那么需要的(前级输入)电流就越小,越有可能说明能前级能
驱动
得了后级。而负载小的话,那么
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