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xilinx仿真(VHDL)
xs767461
2011-12-09 10:08:16
我要仿真数字时钟,有时,分,秒,是不是必须把三个模块放在一个module 文件里吗,还是可以建多个module,小弟是初学者
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xilinx仿真(VHDL)
我要仿真数字时钟,有时,分,秒,是不是必须把三个模块放在一个module 文件里吗,还是可以建多个module,小弟是初学者
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xs767461
2011-12-10
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不写在一起是test文件该这么办,如何写呢,写在哪个module下
woshi_ziyu
2011-12-10
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看自己的习惯
数字通信同步技术的MATLAB与FPGA实现——
Xilinx
_
VHDL
版
数字通信同步技术的MATLAB与FPGA实现——
Xilinx
_
VHDL
版 最新版本 修改了matlab
仿真
路径错误问题
UART收发模块源码(Vivado 2018.1+
Xilinx
/
VHDL
)
1.波特率可以灵活更改,默认115200Baud; 2.校验模式可以灵活更改,包括无校验、奇校验和偶校验,默认无校验; 3.代码注释详细,同时含有testbench
仿真
文件,用于测试闭环条件下的收发工作情况; 4.已经工作于实际工程应用中。
《数字通信同步技术的MATLAB与FPGA实现——
Xilinx
/
VHDL
版》杜勇编著 程序源代码
本书以
Xilinx
公司的FPGA为开发平台,采用MATLAB及
VHDL
语言为开发工具,详细阐述数字通信同步技术的FPGA实现原理、结构、方法,以及
仿真
测试过程,并通过大量工程实例分析FPGA实现过程中的具体技术细节。主要包括FPGA实现数字信号处理基础、锁相环技术原理、载波同步、自动频率控制、位同步、帧同步技术的设计与实现等内容。本书思路清晰、语言流畅、分析透彻,在简明阐述设计原理的基础上,追求对工程实践的指导性,力求使读者在较短的时间内掌握数字通信同步技术的FPGA设计知识和技能。
数字滤波器的 MATLAB 与 FPGA 实现(
VHDL
版本)
数字滤波器的 MATLAB 与 FPGA 实现(
VHDL
版本)。 《数字滤波器的MATLAB与FPGA实现》详细阐述了数字滤波器的实现原理、结构、方法及
仿真
测试过程,并通过大量工程实例分析其在FPGA实现过程中的具体技术细节。其主要内容包括FIR滤波器、IIR滤波器、多速率滤波器、自适应滤波器、变换域滤波器、DPSK解调系统设计等。 数字滤波器 Matlab FPGA
VHDL
.zip_ISE_
VHDL
ISE_
vhdl
xilinx
本系统使用
VHDL
语言进行设计,采用自上向下的设计方法。目标器件选用
Xilinx
公司的FPGA器件,并利用
Xilinx
ISE 7.1 进行
VHDL
程序的编译与综合,然后用Modelsim
Xilinx
Edition 6.1进行功能
仿真
和时序
仿真
。
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