Vivado中Microblaze与DMA的连接怎么设置

wugang589 2017-03-27 11:24:00

在做基于microblaze的DMA传输实验中遇到了一个问题，之前看的例程是ZYNQ的，他有直接的主动器和从动器的连接选项，但是Microblaze里好像就没有，目前也不知道该怎么连线，求大佬指点一二！感激不尽！

就是这上面这两个部分怎么连起来，我的图对吗。不对的话要怎么改呢。

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zhoutong19891227 2017-12-25

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添加完ip后，有一项是自动连线，点一下，让它自己连接就行

1.课程是自己的实验课程2.主要采用的是zcu104 开发板,使用的是官方的例子，增加了简单的修改。例子1：是跑通官方的hdmi rx 和hdmi tx 历程。例子2：是去掉hdmi rx 只剩下 hdmi tx 。（这样可能更容易分析 hdmi 的软件和硬件）3.课程是无声的，主要是自己的学习的分享，稍微收一点辛苦费。4.使用的vivado 版本是2020.1 请大家自行下载和使用。工程中如果涉及到license 的问题，请去官方网站申请。

目录实验介绍硬件设计（Vivado部分）创建工程搭建Block Design MicroBlaze部分外围模块部分时钟模块 Uart部分管脚绑定、时钟约束生成Bit流文件软件设计（SDK部分）板级验证总结往期系列博客实验介绍本节介绍最简单的实验工程，用串口打印helloworld。实验工程基于Vivado2018.2实现下图是实验工程的框图，非常简单，MicroBlaze作为处理软核，搭载着片上存储器BRAM，MB通过AXI互联接到

因工程需要，学习了AXI的三种接口及DMA DDR XDMA，用于vivado中对应ip的使用

阅读本文前，请先阅读：（1）【教程】Xilinx Vivado/Vitis 2020.1创建最简单的MicroBlaze工程运行Hello World C语言程序（不使用外部DDR3内存），并固化到SPI Flash https://blog.csdn.net/ZLK1214/article/details/111824576#comments_14749273 （2）Xilinx 2020.1 MIG核读写DDR3内存，新建工程时配置MIG核的完整步骤 https://blog.csdn.net

水 MicroBlaze 最后的介绍和使用

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