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[小梅哥FPGA] 如何通过动态重配置实现FPGA时钟的实时频率/相位/占空比调整？ PLL和MMCM是实际存在的硬件电路，用以对输入时钟的负面变化，如抖动、频率变化、相位偏移、占空比失真等进行处理。基于该表，用户在初始化Clk_Wiz后，只需要计算好所需的频率、相位、占空比对应的设置值，使用Xil_Out32函数配置对应寄存器即可。通过上述步骤，在平时的开发调试过程中，亦或是一些对于时钟可能有着实时性要求的设计（如数据采集、图像处理）里，我们便可以在无需重新修改设计的前提下，通过AXI4总线来完成对时钟频率、相位的调控，从而达到缩短设计周期以及让设计适应更多场景的目的。 阅读详情

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