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CPU是如何来判断本次取指需要取多少字节的指令数据 [问题点数：50分]

⋅各位大神们帮我看看这个单链表的插入删除算法 ⋅数据结构中单链表的插入有一个小小的疑惑 ⋅sysmets.h>>>>>>这是结构体数组吗？<<<<<<<怎么感觉有点怪。。。。。。。。 更多帖子 关注空间博客 手写的从前66 本版专家分：0 结帖率 20%: 下面是我的猜想，求拍砖指导：
首先，CPU在取指阶段并不知道具体取多长字节的指令，所以根据指令的最大长度~15字节。CPU在一次取指阶段，直接从内存中预取15字节的指令数据。然后对该15字节的指令数据进行长度识别。
不知道上述猜测是否正确？
另外，谁知道指令寄存器（IR）的位数？
求指导，或者说说你们的理解，以及依据

0 2018-11-08 10:56:46

回复数 9 只看楼主引用举报楼主

⋅坚持到最后一天~~~ ⋅这一局怎么破 ⋅我也来散个分~~~ 更多帖子 关注空间博客 早打大打打核战争 本版专家分：27122 红花 2019年2月其他开发语言大版内专家分月排行榜第一 2019年1月 Delphi大版内专家分月排行榜第一 2018年8月 Delphi大版内专家分月排行榜第一 2018年7月 Delphi大版内专家分月排行榜第一 2018年4月 Delphi大版内专家分月排行榜第一 2018年3月 Delphi大版内专家分月排行榜第一 黄花 2016年11月 Delphi大版内专家分月排行榜第二 蓝花 2011年10月其他开发语言大版内专家分月排行榜第三 2010年8月其他开发语言大版内专家分月排行榜第三 2007年5月其他开发语言大版内专家分月排行榜第三: RISC处理器是定长指令，没有这个问题，CISC处理器采用变长指令，指令预取部件会从指令缓存中取一段到指令队列中，并不限于单指令最大长度，可能达到几十字节，和每时钟周期指令发射条数有关。

0 2018-11-08 15:47:18

只看TA 引用举报 #1 得分 0

cpu怎么知道(判断)一条指令有多少个字节？指令译码一般有几个过程（部件）：指令预取、指令预分析（预解码）、解码。预取是从cache或者内存取一系列的字节（大小可以保证至少包含一条指令），并设置一个待分析的位置，预分析从此位置逐字节分析，如果是前缀就设置分析状态（因为前缀可能改变默认地址尺寸和操作数的大小，影响后续指令长度），直到不是前缀，就认为是操作码，x86的op code长度一般为1字节，某些2字节，查表就可以直接找出指令长度了。 ...

⋅此用户还没有发表过任何帖子 关注空间博客 一凡stkeke 本版专家分：0: CPU内部有个指令预取单元，每周期从一级指令缓存中取16字节指令流，此时并不知道取了多少指令。随后有一个指令预译码阶段，会根据x86指令的译码规则界定出每条指令的边界。后续是指令译码阶段，将x86指令翻译成微指令。

0 2019-01-05 21:03:49

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8086的取指过程虽然以前也了解过，但是都忘了，看了下面这篇文章瞬时清楚多了，赶紧记下来，以后再来翻看。点击打开链接物理地址：段地址x16必然是16的倍数，所以一个段的起始地址也一定是16的倍数；偏移地址为16位，16位地址的寻址能力为64KB，所以一个段的长度最大为64KB;还有一点及时可以用不同的段地址和偏移地址形成同一个物理地

⋅AT&T 和 Intel汇编学哪种比较好？？？ ⋅再分享一个有趣的C代码 (比上次的好) ⋅请问那个版权声明前面的那个绿色图标是做什么的？ 更多帖子 关注空间博客 BAO BAO 本版专家分：0: 引用 1 楼早打大打打核战争的回复:
RISC处理器是定长指令，没有这个问题，CISC处理器采用变长指令，指令预取部件会从指令缓存中取一段到指令队列中，并不限于单指令最大长度，可能达到几十字节，和每时钟周期指令发射条数有关。

感觉你懂的很多啊，各种编程知识都精通，学习了

0 2019-01-06 15:15:37

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若每一条指令都可以分解为取指、分析和执行三步。已知取指时间t取指=5△t,分析时间t分析=2△t，执行时间t执行=5△t。如果按顺序方式从头到尾执行完500条指令需___(4)___ △t。 2005年下半年软件设计师上午试题 若每一条指令都可以分解为取指、分析和执行三步。已知取指时间t取指=5△t,分析时间t分析=2△t，执行时间t执行=5△t。如果按顺序方式从头到尾执行完500条指令需___(4)___ △t。如果按照[执行]k、[分析]k+1、[取指]k+2重叠的流水线方式执行指令，从头到尾执行完500条指令需___(5)___△t。 供选择的答案： (4)A.5590 B.5595 C.6000 D.6007<

⋅坚持到最后一天~~~ ⋅这一局怎么破 ⋅我也来散个分~~~ 更多帖子 关注空间博客 早打大打打核战争 本版专家分：27122 红花 2019年2月其他开发语言大版内专家分月排行榜第一 2019年1月 Delphi大版内专家分月排行榜第一 2018年8月 Delphi大版内专家分月排行榜第一 2018年7月 Delphi大版内专家分月排行榜第一 2018年4月 Delphi大版内专家分月排行榜第一 2018年3月 Delphi大版内专家分月排行榜第一 黄花 2016年11月 Delphi大版内专家分月排行榜第二 蓝花 2011年10月其他开发语言大版内专家分月排行榜第三 2010年8月其他开发语言大版内专家分月排行榜第三 2007年5月其他开发语言大版内专家分月排行榜第三: 引用 3 楼那年那人的回复:
Quote: 引用 1 楼早打大打打核战争的回复:

RISC处理器是定长指令，没有这个问题，CISC处理器采用变长指令，指令预取部件会从指令缓存中取一段到指令队列中，并不限于单指令最大长度，可能达到几十字节，和每时钟周期指令发射条数有关。

感觉你懂的很多啊，各种编程知识都精通，学习了

0 2019-01-07 14:09:26

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CPU指令的流水线执行指令集是CPU体系架构的重要组成部分。CPU的指令执行一般包括取指、译码和执行，这是经典的三级指令执行流水线。本文阐述CPU流水线设计的由来和改进技术以及软件开发人员对于流水线需要注意的问题。

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CPU内部有个指令预取单元，每周期从一级指令缓存中取16字节指令流，此时并不知道取了多少指令。随后有一个指令预译码阶段，会根据x86指令的译码规则界定出每条指令的边界。后续是指令译码阶段，将x86指令翻译成微指令。

16字节... 那是386

0 2019-01-07 14:10:04

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⋅此用户还没有发表过任何帖子 关注空间博客 一凡stkeke 本版专家分：0: 引用 5 楼早打大打打核战争的回复:
Quote: 引用 2 楼一凡stkeke 的回复:

CPU内部有个指令预取单元，每周期从一级指令缓存中取16字节指令流，此时并不知道取了多少指令。随后有一个指令预译码阶段，会根据x86指令的译码规则界定出每条指令的边界。后续是指令译码阶段，将x86指令翻译成微指令。

16字节... 那是386

至少在Sandy Bridge微架构上，也还是每次取16字节进行译码，这个值主要取决于流水线中译码器的能力，好多年没有变过了。
参看Sandy Bridge的微架构图

0 2019-01-07 14:42:29

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关于间址周期和执行周期的取操作数的疑问下列描述中( C )是正确的。 A．加法指令的执行周期一定要访存 B．加法指令的执行周期一定不访存 C．指令的地址码给出存储器地址的加法指令，在执行周期一定访存 D．指令的地址码给出存储器地址的加法指令，在执行周期不一定访存 emmm貌似没有说是否考虑间址周期是不用考虑间址周期的，在八套卷模拟二第17题见到类似的一道题，也是没考虑间址周期的去操作数的情况！

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0 2019-01-07 16:15:31

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8086CPU 取指令执行寄存器理解问题描述：学习x86的过程中对cpu的取指、执行工作原理一直是一知半解，上网查了很多相关，发现都讲的不全或者说很模糊。所以，经过自己长时间的查阅总结，终于画出了下图。在此之前需要说明下： cs：代码段寄存器 ip：指令指针寄存器 x86cpu：地址宽度20，但是cpu只能提供16位的访问宽度，因此cpu把两个16位数一个当作段地址，一个当作偏移地址合成一个20位数. 段地址 * 16 +

一凡stkeke 本版专家分：0: L1指令缓存与L1数据缓存不是同一个东西，带宽也不一样。你说的是L1数据缓存的带宽。

0 2019-01-07 18:35:09

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cpu怎样区别指令和数据指令和数据都是以二进制存放在内存中，执行的时候cpu怎么来区分呢？计算机可以从时间和空间两方面来区分指令和数据，在时间上，取指周期从内存中取出的是指令，而执行周期从内存取出或往内存中写入的是数据，在空间上，从内存中取出指令送控制器，而执行周期从内存从取的数据送运算器、往内存写入的数据也是来自于运算器。比如：要计算机做1+2＝？中，“+”表示要做什么和怎样做，1和2则是做的时候需要的

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预解码的指令窗口大小，我查了一下，在skylake架构中仍然是16字节：https://en.wikichip.org/wiki/intel/microarchitectures/skylake_(client) 所以这个数据你说的是对的（虽然core第9代的资料没查到，但是6、7、8代核心都是skylake微架构，应该不会有大的变化）

0 2019-01-08 15:36:50

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CPU指令分析-1 1 Instruction Fetch(IF)阶段 IF阶段的操作有取指令，并决定下一条PC寄存器的内容。IF阶段由流水线寄存器与总线接口组成。 1.1 IF阶段的流水线寄存器(if_reg) 首先PC、指令寄存器以及流水线数据有效标志都设置为初始值以及对应的无效值： if_pc = 0; if_insn = NOP[32'd0]; if_en = DISABLE; 流水线寄存器的刷...

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简述指令周期、机器周期、时钟周期: 指令周期指令周期是CPU从内存取出一条指令并执行这条指令的时间总和，一般由若干个机器周期组成，是从取指令、分析指令到执行完所需的全部时间。机器周期机器周期也叫CPU周期，由于CPU访问一次内存所花的时间较长，因此用从内存读取一条指令字的最短时间来定义。在计算机中，为了便于管理，常把一条指令的执行过程划分为若干个阶段，每一阶段完成一项工作。如，取指令、存储器读、存储器写等，这每一项工作称为一个基本操作

1 计算机基本结构题库: 1、下列哪些定律属于计算机行业的著名“定律”？ A、摩尔定律 B、反摩尔定律 C、墨菲定律 D、马太效应 E、木桶定律 2、当前摩尔定律的常见表述是 A、当价格不变时，集成电路可容纳的晶体管数数量，约每隔6个月便会增加一倍，性能也将提升一倍。 B、当价格不变时，集成电路可容纳的晶体管数数量，约每隔12个月便会增加一倍，性能也将提升一倍。 C、当价格不变时，集成电路可容纳的晶体管...

我和朋友谈论计算机是如何区分指令和数据的经历: 有一天，风和日丽，晴空万里，饭后闲来无事，就聊了聊天，聊着聊着就聊到计算机是如何区分指令和数据的问题了。闲聊怎么会聊到这个问题！？可能因为我们虽不是计算机科班出身，但对计算机都有些兴趣。貌似他喜欢主要是PC游戏和一些其他应用，而不是PC本身。好吧，言归正传！下面，将用M来表示我，用Z标示他。 M：Z哥你知道计算机是如何区分指令和数据的吗？ Z：不知道，没研究过，咋区分？ M：你想想吧

湖南文理学院微机原理期末考试练习（附详细解析）: 1 补码11110110代表的十进制负数是( )。 A:-10 B:8 C:14 D:-12 2 电子计算机中运算器和控制器合称为( )。 A:CPU B:ALU C:主机 D:EMC 3 CPU响应中断的时间是（）。 A:一条指令结束 B:外设提出中断 C:取指周期结束 D:取指周期开始 4 8237A用存作储器与存储器之间的传送时，从源地址中读出的数据通过( )送到的地址单元中去。 A:CPU的通用寄存器 B:8237A中的读写缓冲器 C:8237A的暂存器 D:8237A中的现行字节寄存器 5 将十进制数35转换成二进制数是:( )。 A:100011 B:100111 C:111001 D:110001 6 在8086CPU中，对时钟周期、指令周期和总线周期的长短排序，正确的是( )。 A:当前正在执行的指令与数据都必须存在主存储器内，否则处理器不能进行处理 B:总线周期＞指令周期＞时钟周期 C:时钟周期＞指令周期＞总线周期 D:指令周期＞总线周期＞时钟周期 7 完整的计算机系统应包括( )。 A:运算器,存贮器,控制器 B:外部设备和主机 C:主机和实用程序 D:配套的硬件设备和软件系统 8 将累加器AX的内容清零的正确指令是（）。 A、AND AX，FFH B、XOR AX，AX C、SBC AX，AX D、CMP AX，AX 9 已知(SP)=1310H,执行IRET指令后(SP)为( )。 A:1304H B:1314H C:1312H D:1316H 10 下列哪条指令是正确的？（）。 A、MOV DX，0200H B、MOV AX，[SI][DI] C、MOV BP，AX D、MOV BYTE PTR[BX]，1000 11 指令LEA BX，TAB执行后，其结果是（）。 A、将TAB中内容送BX B、将TAB的段基址送BX C、将TAB的偏移地址送BX D、将TAB所指的存储单元的内容送BX 12 对于下列程序段可用指令（）完成相同功能。 AGAIN：MOV ES：[DI]，AL INC DI LOOP AGAIN A、REP MOVSB B、REP STOSB C、REP LODSB D、REPE SCASB 13 当AH=0FH时，下列指令组不能转到NEXT的是（）。 A、XOR AH，0FH B、TEST AH,0FH JZ NEXT JZ NEXT C、CMP AH，0FH D、SUB AH,0FH JZ NEXT JZ NEXT 14 在虚拟存储器中，当程序正在执行时，（）完成地址映射。 A:程序员 B:编译器 C:装入程序 D:操作系统 15 A:ROM和SRAM B:DRAM和SRAM C:ROM和DRAM D:ROM和CD-ROM 16 在计算机的专业术语中,ROM表示( )。 A:外存储器 B:内存储器 C:只读存储器 D:随机存储器 17 8086在执行IN AL，32H指令时，和的状态为（）。 A、1，0 B、1，1 C、0，0 D、0，1 18 IBM PC微机中将内存分为若干个逻辑段，每个段的容量为（）。 A、等于64K B、小于64K C、大于等于64K D、小于等于64K 19 在数据传送过程中，数据由串行变为并行，或由并行变为串行，这种转换是通过接口电路中的（）实现的。 A:数据寄存器 B:移位寄存器 C:锁存器 D:存储器 20 传送数据时,占用CPU时间最长的传送方式是( )。 A:查询 B:中断 C:DMA D:IOP 21 执行下面的程序段后,AL中的内容是( )。 BUF DW 1234H,5678H,0001H MOV BX,OFFSET BUF MOV AL,2 XLAT A:12H B:34H C:56H D:78H 22 指令MOV NEXT+16，AX采用的寻址方式是（）。 A、立即寻址 B、寄存器间址 C、直接寻址 D、寄存器相对寻址 23 运算型指令的寻址和转移型指令的寻址，其不同点在于:( )。 A:前者取操作数，后者决定程序的转移地址 B:后者取操作数，前者决定程序的转移地址 C:两者都是取操作数 D:两者都是决定程序的转移地址 24 指定起始地址偏移量的伪指令是（）。 A、PROC B、OFFSET C、ORG D、PAGE 25 I/O端口的独立编址方式特点有（）。 A、地址码较长 B、需专用的I/O指令 C、只需存储器取指令 D、译码电路较简单 26 下列不合法的标号是（）。 A、AAA B、LOP C、NEXT D、M1 27 在DMA方式下，CPU与总线的关系是( ). A:只能控制数据总线 B:只能控制地址总线 C:成隔离状态 D:成短接状态 28 CPU中程序计数器(PC)里存放的是( )。 A:指令 B:指令地址 C:操作数 D:操作数地址 29 从存储器中读出或向存储器中写入一个信息所需要的时间称为( )。 A:等待时间 B:存取周期 C:查找时间 D:寄存器 30 下列4个无符号数，其中最小的是（）。 A、50D B、52Q C、2BH D、101001B 31 十进制无符号数7.5用二进制表示应该是（）。 A、0111.1000B B、0111.0101B C、0111.1111B D、0111.0111B 32 8位二进制补码表示的带符号数10000000B及11111111B的十进制数值分别是（）。 A、128和255 B、128和-1 C、-128和255 D、-128和-1 33 内存某字节单元中存放的二进制代码为94H，若将它看作是一个压缩的BCD码，则对应的数为（）。 A、148 B、-20 C、-108 D、94 34 8086CPU中用于中断请求输入的引脚信号是（）。 A、INTR和NMI B、INT和NMI C、INTR和INTA D、INTE和INET 35 关于半导体存储器说法正确的是（）。 A、只读存储器的内容可以被改写 B、静态储存器是指内容不变化的存储器 C、对动态存储器的读是破坏性读，因此读完后要进行写回 D、静态存储器所用元件比动态存储器的多 36 8086的存储器寻址方式计算的是（）。 A.存储器的物理地址 B.存储器的逻辑地址 C.存储器的段基址 D.存储器的有效地址 37 关于分时复用的总线，说法不正确的是（）。 A、采用分时复用的地址数据总线可以有效减少芯片的引脚数 B、分时复用的地址数据总线上的地址信号必须锁存 C、为使用分时复用的地址数据总线，CPU必须提供ALE信号 D、8086中只有分时复用的地址数据总线 38 关于BCD数说法正确的是（）。 A、BCD数53H代表十进制数83 B、6EH不是合法的BCD数 C、在汇编语言中BCD数的加法运算与二制数没有区别 D、压缩的BCD数用8位表示一个BCD数 39 8086的20位地址总线是（）形成的。 A、由段基地与偏移量直接相加 B、段基址右移4位后与偏移量相加 C、段基址左移4位后与偏移量相加 D、段基址乘以2后与偏移量相加 40 为使工作在一般完全嵌套方式的8259A中断控制器能接受下一个中断请求，在中断服务程序结束处应（）。 A、直接执行IRET指令 B、先执行POP指令 C、发送普通EOI指令 D、不用任何处理，8259会自动进行有关处理 41 在8086系统中，规定内存中地址（）的内存单元存放中断服务程序入口地址（中断向量），称为中断向量表。 A、00000H–003FFH B、80000H–803FFFH C、7F000H–7F3FFH D、FFC00H–FFFFFH 42 中断自动结束方式是自动将8259A（）相应位清零。 A、ISR B、 IMR C、IRR D、ICW 43 当有如下中断请求时，微处理器执行完当前指令后，优先响应（）。 A.INT0 B.NMI C.INTR D.单步中断 44 中断类型码为8的中断服务程序入口地址放在内存地址为（）开始的4个单元中。 A.8 B.0 C.32H D.32 45 当INTEL 8253可编程计时器/计数器的RW1、RW0定为11时，写入计数值时的顺序为( )。 A、先写高8位，再写低8位 B、16位同时写入 C、先写低8位，再写高8位 D、只写高8位，低8位自动写入 46 设异步传输时，每个字符对应1个起始位，7个信息位，1个奇偶校验位和1个停止位，如果波特率为9600b/s，则每秒钟传输的最大字符数为（）。 A.9600 B.96 C.960 D. 1200 47 在数据传送的控制方式中，（）对处理器的依赖最小。 A、DMA传送 B、查询传送 C、中断传送 D、IO处理机传送 48 在查询传送方式中，CPU要对外设进行读出或写入操作前，必须先对外设( )。 A、发控制命令 B、进行状态检测 C、发I/O端口地址 D、发读/写命令 49 总线是微处理器、内存储器和I/O接口之间相互交换信息的公共通路。总线中的控制总线是（）的信息通道。 A、微处理器向内存储器传送的命令信号 B、外界向微处理器传送的状态信号 C、A、微处理器向I/O接口传送的命令信号 D、以上A、B、C都正确 50 总线的宽度用数据总线的条数来表示，其单位是（）。 A、位 B、字节 C、字 D、双字 51 当8255A的PC4~PC7全部为输出线时，表明8255A的A端口工作方式是（）。 A、方式0 B、方式1 C、方式2 D、任何方式 52 8位D/A转换器的分辩率能给出满量程电压的（）。 A、1/8 B、1/16 C、1/32 D、1/256 53 由8086//8088构成的计算机对存储器进行读写操作时，信守合同线必须满足的条件是（）。 A、 =0 =0 B、 =0 =1 C、 =1 =1 D、 =1 =0 54 使用2K×8芯片构成32KB存储区共需要（）。 A、8片 B、16片 C、32片 D、64片 55 下列4条叙述中，属于RAM特点的是（）。 A、可随机读写数据，断电后数据全部丢失 B、可随机读写数据，断电后数据不会丢失 C、只能顺序读写数据，断电后数据部分丢失 D、只能顺序读写数据，断电后数据全部丢失 56 8255A具有方式1的端口有（）。 A、端口A和端口B B、端口B和端口C C、端口C D、端口A和端口C 57 对8255A的端口A工作在方式1输入时，C口的（）一定为空闲的。 A、PC4，PC6 B、PC2，PC3 C、PC6，PC7 D、PC5，PC6 58 对8255的C口D4位置1的控制字为（）。 A、00000110B B、00001001B C、00000100B D、00000101B 59 8255A工作在方式1的输出时，信号的低电平表示（）。 A、输入缓冲器满信号 B、输入缓冲器空信号 C、输出缓冲器满信号 D、输出缓冲器空信号 60 8255A的PA口工作在方式2，PB口工作在方式1时，其PC端口（）。 A、用作两个4位I/O端口 B、部分引脚作联络，部分引脚作I/O C、作8位I/O端口，引脚都为I/O线 D、全部引脚均作联络信号 61 8255A的（）一般用作控制或状态信息传输。 A、端口A B、端口B C、端口C D、端口C的上半部分 62 若采用8255A的PA口输出控制一个七段LED显示器，8255A的A口应工作于（）。 A、方式0 B、方式1 C、方式2 D、以上3种中的任一方式 63 8255A有三种方式可供选择，其中方式2双向选通输入/输出数据传送，仅限于（）。 A、端口A B、端口B C、C口的高四位 D、C口的低四位 64 8255A芯片具有（）个端口。 A、2 B、3 C、4 D、5 65 在异步串行通信中，使用波特率来表示数据的传送速率，它是指（）。 A、每秒钟传送的二进制位数 B、每分钟传送的字节数 C、每秒钟传送的字符数 D、每秒钟传送的字节数 66 串行接口器件8251A（）。 A、只能作异步传送 B、只能作同步传送 C、可作并行传送 D、A和B均可 67 8251A芯片复位后首先写入的应是（）。 A、方式控制字 B、状态字 C、命令控制字 D、同步字符 68 当8251方式指令字的D1D0=11，TXC、RXC的频率为19.2KHz，则相应产生的异步数据率为（）。 A、240 B、120 C、450 D、300 69 若传送率为1200，波特率因子n=16，则收、发时钟（RxC.TxC)的频率为（）。 A、1MHz B、19.2KHz C、20KHz D、2400Hz 70 在数据传输率相同的情况下，同步字符传输的速度要高于异步字符传输，其原因是（）。 A、字符间无间隔 B、双方通信同步 C、发生错误的概率少 D、附加的辅助信息总量少 71 8251A状态寄存器有三个出错标志，下列不是其出错标志的是（）。 A、PE B、AF C、OE D、FE 72 串行异步通信的停止位不可以为（）。 A、1位 B、1.5位 C、2位 D、3位 73 8253方式3的计数初值为偶数时OUT端将输出（）的方波。 A、近似对称 B、部分对称 C、对称 D、不对称 74 8253方式2能产生（）的定时信号。 A、周期性 B、间断性 C、连续性 D、重复性 75 8253的三个计数器中每一个都有三条信号线，其中CLK是指（）。 A、定时计数脉冲输入 B、输出信号 C、选通输入 D、门控制输入 76 写入8259A芯片的操作命令字OCW1是FEH,则没有被屏蔽的中断源是（）。 A、IR0 B、IR1 C、IR2 D、IR3 77 PC/XT机中若对从片8259A写入的ICW2是70H，则该8259A芯片的IRQ5的中断矢量存储的地址是（）。 A、75H B、300H C、280H D、1D4H 78 3片8259A级联起来，可管理（）级中断。 A、24 B、23 C、22 D、21 79 若8259A工作在优先级自动循环方式，则IRQ4的中断请求被响应并且服务完毕后，优先权最高的中断源是（）。 A、IRQ3 B、IRQ5 C、IRQ0 D、IRQ4 80 CPU响应中断请求和响应DMA请求的本质区别是（）。 A、中断响应靠软件实现 B、响应中断时CPU仍然能控制总线，而响应DMA请求时，CPU要让出总线 C、速度慢 D、控制简单 81 设置特殊屏蔽方式的目的是（）。 A、屏蔽低级中断 B、响应高级中断 C、响应低级中断 D、响应同级中断 82 CPU在响应INTR请求时，不包括的条件有（）。 A、IF=1 B、指令周期结束 C、无NMI请求 D、TF=1 83 8086/8088的中断是向量中断，其中断服务程序的入口地址由（）提供。 A、外设中断源 B、以中断控制器读回中断类型号左移2位 C、CPU的中断逻辑电路 D、由中断类型号指向的中断向量表中读出 84 “INT n”指令中断是（）。 A、通过软件调用的内部中断 B、由系统断电引起的 C、由外部设备请求产生 D、可用IF标志位屏蔽的 85 在DMA方式下，将内存数据传送到外设的路径是（）。 A、CPU→DMAC→外设 B、内存→数据总线→外设 C、内存→CPU→总线→外设 D、内存→DMAC→数据总线→外设 86 CPU在数据线上传输的信息不可能是（）。 A、数据 B、状态 C、命令 D、模拟量 87 8086/8088CPU状态标志寄存器中IF=1时，表示（）。 A、CPU可以响应非屏蔽中断 B、CPU可以响应内部中断 C、CPU可以响应可屏蔽中断 D、CPU禁止响应可屏蔽中断 88 8086/8088CPU指令队列的作用是（）。 A、暂存操作数 B、暂存操作数地址 C、暂存预取指令 D、暂存指令地址 89 8086/8088微处理器的一个典型总线周期需要（）个T状态。 A、1 B、2 C、3 D、4 90 8086/8088可寻址访问的最大I/O空间为（） A、16K B、64K C、640K D、1M 91 伪指令VAR DD ？将在内存预留的存储空间是（）。 A、1字节 B、2字节 C、4字节 D、6字节 92 下列描述中正确的一项是（）。 A、指令语句和伪指令语句都能经汇编翻译成机器代码 B、指令语句和伪指令语句都可以执行语句 C、汇编语句包括指令语句、伪指令语句和宏指令语句 D、汇编语言是只由指令语句构成 93 若要检查BX寄存器中的第12位是否为1，应该用（）指令。 A、OR BX，1000H B、TEST BX，10000H JNZ NO JNZ YES C、XOR BX，1000H D、AND BX，1000H JZ YES JNZ YES 94 8086CPU中指示下条指令有效地址的指示器是（）。 A、IP B、SP C、BP D、SI 95 8086最大工作模式的特点是（）。 A、M/IO引脚可直接引用 B、由编程进行模式设定 C、需要总线控制器8288 D、适用于单一处理机系统 96 最小工作模式的特点是（）。 A、CPU提供全部的控制信号 B、由编程进行模式设定 C、不需要用8286收发器 D、需要总线控制器8288 97 8086CPU有两种工作模式，即最小工作模式和最大工作模式，它由（）决定。 A、 B、 C、 D、HOLD 98 8086/8088的存储器可以寻址1MB空间，在对I/O进行访问时，20位地址中只有（）有效。 A、高 16位 B、高8位 C、低16位 D、低8位 99 CPU响应单个可屏蔽中断的条件是（）。 A、CPU开中断 B、外设有中断请求 C、外设中断请求信号不屏蔽 D、同时满足上述A、B、C要求，且正在执行的指令执行完毕 100 假设（SS）=2000H，（SP）=0012H，（AX）=2213H，执行PUSH AX后，（）=22H。 A、20014H B、20011H C、20010H D、2000FH

计算指令长度（汇编）: 指令长度与寻址方式有关系，规律或原则如下：一、没有操作数的指令，指令长度为1字节。如 es: ds: cbw xlat 等。二、操作数只涉及寄存器的指令，指令长度为2字节。如 mov al,[si] mov ax,[bx+si] mov ds,ax 等。三、操作数涉及内存地址的指令，指令长度为3字节。如 mov al,[bx+1] mov ax,[bx

主存容量为16M字节，按字节编址，最少要多少位?: 主存容量为16M字节，按字节编址，最少要多少位? 解析：先转换成b 16MB=16*1024KB=(16*1024)*1024B=16777216 B 因为： 1024*1024=2^(10+10); 16=2^4 所以： (16*1024)*1024B = 2^(10+10+4)=2^24 一位地址总线可以寻址2位。 16MB＝16×1024×1024＝2^24 2的24次方。所以要24位...

MIPS 下非对齐访问的问题: http://bbs.ednchina.com/BLOG_ARTICLE_766646.HTM MIPS 下使用访存指令读取或写入数据单元时，目标地址必须是所访问之数据单元字节数的整数倍，这个叫做地址对齐。比如在 MIPS 平台上，lh 读取一个半字时，存储器的地址必须是 2 的整数倍； lw 读取一个字时，存储器的地址必须是 4的整数倍； sd 写入一个双字时，存储器的地址

ARM7各种指令的周期数: 转自：http://www.elecfans.com/emb/arm/2009071678028.html ARM7具有3级流水线结构（取指、译码、执行），对大多数指令来说每条流水线的处理都是单周期的，不过某些情况下，取指和执行的周期数会延长，导致流水线进入stall状态，指令执行时间超过1个周期。经过在LPC213x/214x（NXP ARM7TDMI-S）上的试验，得出各类指令的执

计算机如何区别指令和数据？: 转自计算机区分指令和数据有以下2种方法：  通过不同的时间段来区分指令和数据，即在取指令阶段（或取指微程序）取出的为指令，在执行指令阶段（或相应微程序）取出的即为数据。  通过地址来源区分，由PC提供存储单元地址的取出的是指令，由指令地址码部分提供存储单元地址的取出的是操作数。通常完成一条指令可分为取指阶段、分析阶段和执行阶段。在取指阶段通过访问存储器可将指令取出；在

指令的编码与译码原理: 介绍CPU指令的设计和实现，着重阐述指令的的编码和译码原理。

jmp用法以及原理分析: 段内转移和段间转移转移指令：控制cpu执行内存中的某行代码，可以通过修改IP或者同时修改cs:ip 只修改IP的称为段内转移：jmp ax 相当于 mov ax,ip jmp ax 同时修改cs:ip的叫段间转移：jmp 1000:0(这是debug语法，只能在debug中使用）段内转移分为短转移和近转移短转移ip修改范围：-128-127（一个有符号的字节范围）

关于arm中的字节对齐: 大多数计算机使用字节作为最小的可寻址存储器单元,一个地址对应一个字节的数据.对于32位arm,取指是以4字节为单元取的,所以需要以4字节对齐.

指令流水线的计算: 若每一条指令都可以分解为取指、分析和执行三步。已知取指时间t取指=4△t，分析时间t分析=3△t，执行时间t执行=5△t。如果按串行方式执行完100条指令需要 （2） △t。如果按照流水方式执行，执行完100条指令需要（3） △t。（2）A．1190 B．1195 C．1200 D．1205 （3）A．504 B．507 C．508 D．510 试题解析：串行执行时，总执行时间=1

Coursera 计算机组成学习记录：单周期处理器quiz（习题记录）: 记录第一次学习的习题，具体的分析与复习，另写文章记录。 1.第 1 个问题处理器设计的五个步骤如下，请正确排序。 1 连接组件建立数据通路 2 为数据通路选择合适的组件 3 集成控制信号，形成完整的控制逻辑 4 分析指令系统，得出对数据通路的需求 5 分析每条指令的实现，以确定控制信号答案样例格式：12345 正确回答 42153 2.第 2 个问题课程中...

CPU预取与性能简介: CPU预取与性能简介作者:yanyun 时间:September 26, 2017 分类:Intel CPU 转自：http://linuxperformance.top/index.php/archives/109/ 随着计算机硬件的发展，CPU主频已由过去 MHz 发展到了现在的 GHz，而常用硬盘的存取速率还是几百MB每秒，虽然现在SSD卡也可以达到几个GB，但是...

写个简单的函数，用于判断CPU的字节序（little endian/big endian）: 这个题目是PPS2013校园招聘的一个笔试题目，

Coursera 学习记录：指令系统体系结构quiz（习题记录）: 以下为单独的题目记录，具体的分析复习，再另写文章。 1.第 1 个问题下列关于CISC和RISC的描述错误的是？ RISC指令的操作数必须预存于寄存器中 RISC架构的指令种类通常比CISC架构更少 RISC指令长度是固定的 CISC指令长度是不固定的 CISC指令的操作数必须预存于寄存器中 2.第 2 个问题下列关于Intel处理器及其推出时间描述错误的是？ I...

性能估算(修改版): 1. 本转载文章对设计者在性能估算上非常有参考价值； 2. 负责技术运营、运维的同学前期早参与开发设计是非常有必要的，特别是一些经验丰富的同学在线上大流量下见多识广，对一些性能、瓶颈值比较熟悉； 3. 开发的系统适合运营生产环境是一个上线的准入条件，否则运营成本巨大，即使上线了也是问题服务，不如在上线前就把关解决掉。给定一个问题，往往会有多种设计方案，而方案评估的一个重要指标就是性能，

ARM微处理器中支持字节、半字、字三种数据类型，地址的低两位为0是啥意思？: 1、字对齐数据，也就是说每个数据都是用字(32位)来表示的，而ARM中的存储单元都是以字节为单位，那么要索引一个数据，需要连续的4个字节才行，比如，0x0000_0000~0x0000_0003这四个单元存储一个数据，紧接着0x0000_0004~0x0000_0007这四个单元存储第二个数据，那么依此类推，每个数据的存储起始地址为： 0x0000_0000 0x0000_0004

C#中判断字节多少，以及按字节截取: 1、函数判断字节多少 string strinit=“要判断的字符串”; string getStr=System.Text.Encoding.Default.GetBytes(strinit).Length; 2、按字节截取字符串长度按100个字节算 /// /// 截取指定字节长度的字符串 /// /// 原字符串 /// 截取字节长度 /// publ

2003-2005上午试题分章别类(上): 第一章计算机系统知识2005年11月●阵列处理机属于___(1)___计算机。供选择的答案：(1)A.SISD 　　　　　　B.SIMD　　　　　　　 C.MISD 　　　　　　　D.MIMD●采用___(2)___不能将多个处理机互连构成多处理机系统。供选择的答案：(2)A.STD总线　　　　Ｂ.交叉开关　　　　　Ｃ.PCI总线　　　　　D.Centronic总线

Cortex-M3内核简析: MCU的主要组成有：内核、储存器、外设。大部分刚接触MCU的人员一般是从关注外设的使用开始，但对于要深入理解MCU工作原理，了解MCU的内核、储存器这两部分内容是很有必要的。本文将以Cortex-M3内核为例对MCU的内核做一个简要分析。主要关注以下三个问题：问题一、定义：Cortex-M3内核是什么？问题二、结构：Cortex-M3架构是怎么样的？问题三、功能：Cortex-M3架构

java如何判断一个String类型数据由多少字节组成？: 转自：http://blog.csdn.net/a19881029/article/details/7902701 问题描述：向Oracle数据库中一varchar2(64)类型字段中插入一条String类型数据，程序使用String.length()来进行数据的长度校验，如果数据是纯英文，没有问题，但是如果数据中包含中文，校验可以通过，但是在数据入库时经常会报数

CPU访问内存: 首先我们需要一个引子，引子如下：作为一个计算机领域的工程师，这里有一个问题：有一个10米深的水池需要测量其水深，并在计算机（或者微机）上显示测量结果，保留小数点后一位。请概要的设计这个系统。分析如下： 10米深的水池，需要保留一位小数，所以测量精度应该是0.1米，如下图所示：采样的方法，我们采用最简单的水漂，即随水深上下浮动，带动滑线变阻器。

arm:PC=当前执行指令地址+8: AMR7的三级流水线如下： ARM9是五级流水线，ARM9的五级流水线如下：可见，ARM9和ARM7中都是PC=当前执行指令地址+8的根本的原因是，两者的流水线设计中，指令的执行阶段都是处于流水线的第三级。

稍加详细的ATR信息，将完善历史字节部分: //Reset3B FB 13 00 00 81 31 FE 45 65 46 53 07 01 00 71 C6 80 61 17 D4 //点击显示详细信息,00402D3D,00000000,00000015//复位应答 ATR// 开始│ │奇偶下一// 位 │←───

cpu指令如何读写硬盘: 在《cpu解读一》中，我们提到cpu的主要作用之一就是控制设备之间的数据交互。这其中自然也包括了硬盘。系统的所有数据基本都在硬盘中，所以知道怎么读写硬盘，对程序来说非常重要，所以我们先来探索下传说中的pio模式。 cpu要想直接访问设备里的数据，必须对设备存储空间进行编址。而硬盘数据数据太大，直接编址数据线成本太高，于是设计上在这类设备和总线之间加了一个控制器。这个控制器里有少量寄存器可以被

CPU内部组成结构及指令执行过程: 计算机的基本硬件系统由运算器、控制器、存储器和输入、输出设备五大部件组成。运算器和控制器等部件被集成在一起统称为中央处理单元（Central Processing Unit，CPU）。 CPU的功能（1）程序控制 CPU通过执行指令来控制程序的执行顺序，这是CPU的重要职能。（2）操作控制一条指令功能的实现需要若干个操作信号来完成，CPU产生每条指令的操作信号并

单指令周期CPU---加载存储指令的实现: 单周期cpu mips

数据如何来判断: 各位大神:怎么来判断数据是我所需要的数据呢？rn如：我上位机得到一串数据！我上位机的通信协议是这样的，开始标识符是AA 55 "G" "P" "V"rnbytsend(0) = &HAArnbytsend(1) = &H55rnbytsend(2) = ASC("G")rnbytsend(3) = ASC("p")rnbytsend(4) = ASC("v")rnbytsend(5) = 0rnbytsend(6) = 0rnbytsend(7) = &HArnbytsend(8) = &HDrnrn结束符是&HA &HDrn中间是我需要的数据，，我怎么来对接受到的进行判断！最好哪位大神提供下代码，，，万分感谢！rn

计算机在一个指令中的过程中，为从内存读取指令操作码，首先要将（）的内容送到地址总线上: A：指令寄存器（IR） B：通用寄存器（GR） C：程序计数器（PC） D：状态寄存器（PSW）答：C

2个小编程题（字节多少位为1，判断LSB or MSB）: 1计算一个字节里有多少个bit被置1，多少位被置换为0： int chek_byte_1(char x) { int i,count_1=0; for(i=0;i>i)&1）==1) count_1++; } return count_1;

关于如何获得截取byte[]的高低位？: 最近利用CH340B串口进行Android端的软件开发，通讯协议中要求使用拼接byte[]来进行指令的发送，其中涉及到了类型转换和byte高低位的截取，这里小结一下。由于发送指令参数是int型数据，所以基本的方法是利用int转byte[]来进行截取，这里再写一下关于int和byte[]之间的转换，不论是从高位到低位还是低位到高位，方法基本一样： 1.int转byte[](高位到低位) pu

mov [2000h],al指令需要几个总线周期？: mov [2000h],al指令需要几个总线周期？问题：在《16/32位微机原理汇编语言及接口技术》书的第107页有这样一段话:“mov [2000h],al”读到指令队列需要3个“存储器读”总线周期，而执行它只需1个“存储器写”总线周期。您能详细讲讲为什么是3个“存储器读”1个“存储器写”。对应习题4.13指令“add [2000h],ax”该如

MCS-51单片机的指令时序: 时序是用定时单位来描述的，MCS-51的时序单位有四个，它们分别是节拍、状态、机器周期和指令周期，接下来我们分别加以说明。 ·节拍与状态：我们把振荡脉冲的周期定义为节拍（为方便描述，用P表示），振荡脉冲经过二分频后即得到整个单片机工作系统的时钟信号，把时钟信号的周期定义为状态（用S表示），这样一个状态就有两个节拍，前半周期相应的节拍我们定义为1(P1)，后半

图不略--画出主机框图，并在图中按序标出完成减法指令“SUB M”的信息流程。: （图不略，我有图，不用去翻课本）画出主机框图，并在图中按序标出完成减法指令“SUB M”（M为主存地址）（包括取指阶段）的信息流程。

串口发送一帧数据时，两个字节的间隔时间是多少？: 串口发送一帧数据时，两个字节的间隔时间是多少？

为什么用 ping 命令计算目标主机 MTU 时，缓冲区大小要减掉 28 字节，才是真正的MTU值？: 我在未学习网络基础时曾经也有过这个疑问，而且没有得到答案，今天我将答案简单写下来，因为我也在学习过程中，内容可能有错误，请指正。首先要说这个问题，设计到OSI7层模型中的2、3、4层（数据链路层、网络层、传输层），会有几个point： 1、MTU是什么？它属于第几层的东东？ MTU其实属于【作用于３层】的一个概念，它的目的是限制【IP封包大小】的值，这个大小包括IP封包的包头。

php 字符和字节: 字符的简介：在js中，中文占两个字符，英文占一个字符；在php中，不同编码下不相同，在GBK/GB2312编码下一个中文占2个字符，UTF-8/unicode编码下一个中文占3个字符； php 字节 和字符 php在UTF-8编码下，一个汉字占3个字节，gbk编码下只占2个字节。 zìfú 字符是可使用多种不同字符方案或代码页来表示的抽象实体。例如

CPU访存过程: 操作系统管理的是虚拟存储，在操作系统笔记:(三)虚拟内存分配我曾谈过虚拟存储，即OS将逻辑地址转化为物理地址的过程，这部分是软件(OS)完成的，实际上，在硬件层我们还有Cache缓存做命中工作，提高访问效率，两者结合就构成了CPU的完整访存过程。简单的说，分以下几步: 操作系统的存储管理(虚拟存储)将逻辑地址转化为物理地址(这里面也有缓存，TLB页表缓存) 看Cache能否命中，命中则直接访存，否则

容量和速度单位：bit/byte/Hz: 本文主要罗列IT领域中经常用到的容量和速度单位，如bit位、byte字节和Hz。

【计算机基础】2.计算机中数据的表示(2): 计算机中数据的表示(2) 一、机器码十进制数与字符编码的表示 ● BCD码：用4位二进制数表示表示以为十进制数，叫二-十进制编码，叫BCD码有权码：用的最多的是8421码，即4个二进制位的权从高到低分别是8、4、2、1. 无权码：常用余3码和格雷码余3码：在8421基础上，把每个数的代码加上0011 格雷码：相邻的两个代码之间只有1位不同 ASCII码(美国标准信息...

图解数据读写与Cache操作: 高速缓存（Cache）主要是为了解决CPU运算速度与内存（Memory）读写速度不匹配的矛盾而存在，是CPU与内存之间的临时存贮器，容量小，但是交换速度比内存快。本文针对Cache的读写进行简单说明并通过示意图演示什么时候需要写回（flush）缓存，什么时候需要作废（Invalidate）缓存。

使用jquery获取url及url参数: 使用jquery获取url以及使用jquery获取url参数是我们经常要用到的操作1、jquery获取url很简单，代码如下：?1window.location.href;其实只是用到了javascript的基础的window对象，并没有用jquery的知识。2、jquery获取url参数比较复杂，要用到正则表达式，所以学好javascript正则式多么重要的事情首先看看单纯的通过javascri...

各种数据类型在16位、32位和64位系统下所占字节差异简介: 编写C、C++程序时需要考虑每种数据类型在内存中所占的内存大小，即使同一种数据类型在不同平台下所占内存大小亦不相同，具体对比如下： 数据类型 16位系统(byte) 32位系统(byte) 64位系统(byte) 备注 char 1 1 1 short 、unsigned short 2 2 2 int、...

ARM处理器中PC值=当前程序执行地址 + 8的根本原因: ---2019.1.14 Update 根据评论指出，标题有误导，将 PC值 = 当前指令地址 + 8 更正为 PC值=当前程序执行地址 + 8 ------ 思考个小问题，处理器执行一条指令需要几个时钟周期。对于软件工程师来说，印象流我们可能会觉得执行一条指令一个时钟周期嘛，一条指令算是一个最小的原子操作，不可能再细分了吧。如果看看诸如《see mips run》，《arm体系架构》...

判断一个字符是双字节还是单字节: 对于字符串的处理，经常会遇到需要判断字符是双字节还是单字节（或者全角和半角）的情况，因为双字节字符和单字节字符在屏幕上所占用的空间是不同的，通常情况下双字节字符占用的空间是单字节字符的两倍。比如，一个字符串，可能包含中文英文数字和各种符号等等，将其输出到屏幕上，需要根据长度判断在哪里进行截断（网页编程中经常用到）。最常见的两种方式。一种是通过String的getBytes().length来判断

属性指令的解析原理——以 v-if 为例: 问题提出面试中，面试官不免要问，关于v-if这类的指令，实现的原理是什么？效果图示： HTNL： &lt;body&gt; &lt;div id="root"&gt; &lt;div v-if="true"&gt;我是指令的展示和隐藏&lt;/div&gt; &lt;div v-if="false"&gt;我是要隐藏的&lt;/

32位和64位系统区别及字节对齐: (一）64位系统和32位区别？（二）数据类型对应的字节数（三）字节对齐

32位单片机一个32位地址代表一个字节而不是4个字节（32位）: 在数据手册上，BSRR的偏移地址为0X18，然后手册讲完BSRR后直接讲LCKR了，并且LCKR的偏移地址是 OX1C 。所以根据 OX1C-0X18=0X04 就知道BSRR是32位寄存器了。因为一个地址里面有一个字节的内容，一个字节是8位。 32位单片机一个32位地址代表一个字节而不是4个字节（32位）

EQU,及变量定义伪指令与内存划分的关系: INTPND EQU 0x01e00004此处为定义以下等值伪指令均不参与编译;EQU伪指令只起一个程序预编译器接口作用，此处可看作类似于C语言宏定义，为了方便阅读，实际上并不是;定义常量INTPND,程序出现此标号时将被替换，而其他的定义数据的伪指令则需要提前划定定义在存储器的位置;是代码段还是数据段，例如下面的代码SMRDATA DATA;*****************

《Java平台体系》——第二章 JVM——从JVM指令到机器指令: 我们前面也聊过JVM在规范层面引入字节码的好处，但将Java字节码翻译成机器指令是需要时间的。所以如何提高Java指令到机器指令的转化效率成为每一个JVM实现必须考虑的问题。如果发挥我们的想象力来理解应该有如下方法： □ 把Java字节码直接再次编译成本地可执行代码，执行的时候就没有JVM的事了。 □ JVM在运行期负责不断地解释了。把Java字节码直接编译成机器码

64位多核 MIPS 异常和中断结构: 64位多核 MIPS 异常和中断结构 1. 概述 MIPS 统称异常（同步事件）和中断（异步事件）为例外 (Exception) 引入异常则是为了解决处理器运行过程中的一些意外情形，比如执行流中有非法指令（无法被处理器辨识的指令），访问了没有映射的虚拟地址等等。中断的引入则是提供一种 IO 设备请求处理器服务的一种通讯机制；往往是由外部设备主动发起（给处理器的中断引脚一个信号），

计算机组成原理十套练习-白中英（B1 B2 B3 B4 B5 B6 B7B8 B9 B10）: 1 从器件角度看，计算机经历了五代变化。但从系统结构看，至今绝大多数计算机仍属于（ B ）计算机。 A 并行 B 冯·诺依曼 C 智能 D 串行计算机组成原理十套练习-白中英（B1 B2 B3 B4 B5 B6 B7B8 B9 B10） 3 存储单元是指（ B ）。 A 存放1个二进制信息位的存储元B 存放1个机器字的所有存储元集合 C 存放1个位元组的所有存储元集合D 存放2个位元组的所有存储元集合

CPU字长、数据总线宽度、几位的处理器之间的关系: 字长是指计算机内部参与运算的数的位数。它决定着计算机内部寄存器、ALU和数据总线的位数直接影响着机器的硬件规模和造价。字长直接反映了一台计算机的计算精度为适应不同的要求及协调运算精度和硬件造价间的关系大多数计算机均支持变字长运算即机内可实现半字长、全字长或单字长和双倍字长运算。微型机的字长通常为4位、8位、16位和32位64位字长的高性能微型计算机也已推出。字长对计算机计算

声音设备返回的input buffer总是320个字节: 首先简单介绍下，G711的压缩比，其实比较低2:1的压缩,一般采样的数据都是一次性的读取320字节,至于为什么是320呢？原因是这样的: 语音帧的最小单位是20ms，也就是在8KHZ 16bit的基础上，一帧语音可以播放20ms，这20ms对应的长度就是320字节，按帧的概念来说，就是最少必须编码一帧的数据，也就是达到最小的语音播放单位. 320个字节是这么算出来的： 8Kh

汇编JMP语句 IP值和偏移量的问题。问题如下，我想知道IP值是怎么变化的。还有8086一条指令占个几字节啊: 汇编JMP语句 IP值和偏移量的问题。问题如下，我想知道IP值是怎么变化的。还有8086一条指令占个几字节啊 2011-10-16 22:26干物虫子 | 分类：汇编语言 | 浏览404次 1：在0624单元内忧一条二字节JMP SHORT OBJ指令，如果其中偏移量是27H，则转向地址OBJ的值是多少？ 2：有指令JMP NEAR PTR qus，一直指令在内存的偏移地址为100H，qu

强连通分量及缩点tarjan算法解析: 强连通分量：简言之就是找环（每条边只走一次，两两可达）孤立的一个点也是一个连通分量使用tarjan算法在嵌套的多个环中优先得到最大环( 最小环就是每个孤立点）定义： int Time, DFN[N], Low[N]; DFN[i]表示遍历到 i 点时是第几次dfs Low[u] 表示以u点为父节点的子树能连接到 [栈中] 最上端的点 int

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