Xilinx SDK下载失败的解决方法

在视频合成项目中，用到了Xilinx SDK，通过microblaze软核处理器完成前端相机OV4689和后端HDMI图像发送芯片ADV7511的配置。 开发平台 硬件平台：Xilinx KC705开发板， novel-supertv merge前端板 软件平台：Keil，ISE14.7，Vivado2015.4，Xilinx SDK 在本项目中有ISE或Vivado生成的

ISE中下载Xilinx的bit文件失败时的处理方案

ISE中下载Xilinx的bit文件失败时的处理方案：”DONE did not go high”. 在使用ISE进行FPGA的bit文件下载时，经常会遇到下载失败的问题，提示： “DONE did not go high”. 下面提供以下解决方案（根据不同的情况，产生上述问题的原因实在太多，不一一解释了） 1. 关闭工程后重新打开ISE，将下载电缆重新安装（或进行更换），必要时重启电脑；

ZYNQ的三种启动方式-JTAG、SD card、Flash

ZYNQ的三种启动方式-JTAG、SD card、Flash 转自： https://blog.csdn.net/u014485485/article/details/78324183 前言：   前面我们都是使用JTAG方式下载比特流文件，然后下载elf文件，最后点击Run as或者Debug as来运行程序。JTAG方式是通过tcl脚本来初始化PS，然后用JTAG收发信息，优点是可以在...

STM32F103 OV7660 这段代码把sccb的SIO_C和 SIO_D设置到了哪两个引脚上了？

#define SCCB_SIO_C 6 #define SCCB_SIO_D 7 #define SIO_D_IN {GPIO_InitStructure.GPIO_Pin = 1<<SCCB_SI

xilinx basys3开发板，ov7670摄像头采集处理的数据怎么传回pc？

xilinx basys3开发板，ov7670摄像头采集处理的数据怎么传回pc？ 最近要做一个手势识别的游戏系统，最好能控制PC鼠标，有没有做过类似项目的朋友给些指导？

JTAG扫不到Zynq FPGA的原因排查

1JTAG 6根 线序，JTAG上排阻 是否焊上；2 FPGA 各种电源，时钟有没有，非JTAG模式程序是否加密；关键性信号 MIO5，4，3PUDC，CFGBVS等信号检查3 FPGA上电时序，几个复位信号POR，SRST的状态对不对，时序关系对不对，手册要求：PS_POR_B会不会给的太早了...

USB-Blaster:unable to scan the device chain,Can't scan JTAG chain

1、USB-Blaster 成功安装后<em>无法识别</em>FPGA芯片，具体表现为USB-Blaster:unable to scan the device chain,Can't scan JTAG chain; 2、下载器为正版下载器，USB-Blaster 成功被识别，最后发现是下载器不支持最新的FPGA。...

vivado不能连接zedboard编程口JTAG

在使用vivado下载生成的bit流文件时，需要将USB接到zedboard板上的JTAG口，初次连接时会有安装驱动的提示，如果安装驱动失败或者没有提示可以按照如下步骤： 1.确保安装了CypressDriverInstaller_1可到官网下载，确保上电，连接PROG口 2.cd &amp;lt;path to vivado&amp;gt;\Vivado\2015.4\bin，目录下有hw_server（w...

JTAG接口无法连接的问题

题目：JTAG接口无法连接问题   本文包含两部分内容：1）续写TI DSP连接不上的问题；2）顺便提一下Xilinx FPGA的JTAG口连接不上的问题。   一、TI DSP为啥连接不上？ 半年前发过一篇博文《DSP为啥连接不上？TMS320C6416T+seed-XDS510 PLUS》（链接http://blog.csdn.net/jbb0523/article/details/

zynq系列器件通过JTAG口访问DDR

          在开发过程中硬件调试不免会遇到一种情况，就是可能SD卡、USB和网口都没有调通，但是需要一些少量数据对特定功能进行验证，这时通过JTAG接口Restore数据到DDR或从DDR Dump数据到PC机不失为一种有效选择。Xilinx SDK就支持这种功能，以下做一个简单的介绍：          (1)步骤 1：在 SDK 下建立 System Debug 仿真，并选择当前的目...

小心FPGA的JTAG口(上电和下电顺序)

同志们，根据ALTERA官方FAE（现场应用工程师）的强烈建议，请注意不要随意带电插拔你的JTAG下载接口，否则会损坏FPGA芯片的JTAG口信号管脚。 现象： 在排除了下载线的问题后，还是不能访问FPGA的JTAG口，那么很有可能你的FPGA芯片的JTAG口已经损坏。此时请用万用表检查TCK，TMS，TDO和Tdi是否和GND短路，如果任何一个信号对地短路则表示JTAG信号管脚已经损坏。

【Zynq学习笔记2】SDK使用JTAG调试

本文使用的开发板为ZC702. 1.连接仿真器，并将SW10和SW16设置为如下模式：   其他选项可参考下表【来源于UG850：ZC702 Evaluation Board for the Zynq-7000 XC7Z020 All Programmable SoC User Guide 】 2.在SDK中 在“Project Explorer”窗口工程上右键->D

ZYNQ芯片的ARM端无法被JTAG检测到

   通过JATG调试ZYNQ芯片时，发现在进行PS端应用程序debug情况下提示无法找到ARM设备；但是在Vivado环境下能连接到设备，就是说PL端可以正常使用，PS端无法使用。    从这个结果出发分析，PL端能使用证明芯片的工作电压正常(PL端与PS端电压相同)、复位模块正常、晶振正常(通过示波器观察)。通过查找相关文档发现是配置错误，MIO[2]引脚通过电阻上拉电源。   将MIO[...

chipscope 连接不上FPGA 或找不到JTAG

又可能是因为电脑是64位的 ，却打开了32位的chipscope ，换成64位的就可以了

xilinx zynq7000，SDK平台使用JTAG 加载VxWorks并运行的方法和步骤

xilinx的SDK开发平台提供了xsct命令行接口，该接口在硬件调试初期非常方便，可以使用JTAG把vxworks镜像下载到DDR中直接运行，下面是使用的脚本 connect targets 2 rst cd c:/workspace <em>fpga</em> download.bit source ./ps7_init.tcl ps7_init dow vxworks.elf con ...

zynq qspi 增加jtag调试和固件升级设置，启动镜像。

最近这几天想固件升级的问题，开始考虑双u-boot，然后在fsbl里面增加一个多镜像的操作，增加一段代码驱动网络，和升级软件对码成功后，跳转到第一个u-boot，自动运行cmd从tftp上下载BOOT.bin，deivcetree.dtb,uImage和一个装有格式化emmc的小软件uramfs.image.gz，用于启动运行格式化后重启，串口全程输出文字信息，必要点灯提示。如果对码不成功跳转另一

FPGA 代码固化在内部ROM的方法

最近回家放了几天暑假，虽有保持学习，但在一个完全脱离电脑的环境，嘿嘿，只能看点理论啦。今天回来，把FPGA 的代码烧写到ROM 里面去，之后上电自动配置。本文实在简单浅薄，仅作我个人的记录，以防日后忘记配置步骤之用。（CSDN博客的图片功能还没好，郁闷阿，只能纯文字记录了。）

02-ZYNQ学习（逻辑篇）之FPGA LED控制实验

参考（ALINX黑金Zynq7000开发平台配套教程V1.02.pdf）第 7 章 FPGA LED 控制实验 使用Vivado，进行逻辑部分实验开发。实现流水灯功能。 主要包括以下几个步骤： （1）安装VIVADO 软件 （2）查看开发板原理图 （3）创建工程 （4）编写流水灯的 verilog 代码 led.v （5）添加 XDC 管脚约束文件 led.xdc （6

FPGA在线升级的一种可行方案

Altera的Cyclone IV系列芯片，用EPCS系列的spi flash可以完成在线升级的功能。整体思路是把pof文件写进EPCS，就可以实现FPGA的上电自动加载，从EPCS里读出FPGA的配置。 一、 硬件设计   二、 控制逻辑 FPGA上电时，会自动通过DATA0,DCLK,nCSO,ASDO这四个引脚读取EPCS芯片里的数据，从第一个page开始遍历整个flash。

关于zedboard无法烧写bit流文件的解决办法

过个年回来各种郁闷，zedboard无法烧写bit流文件 参考链接： http://blog.sina.com.cn/s/blog_98740ded0101dij6.html http://blog.sina.com.cn/s/blog_c248f6b70101apx9.html 1.      libCseDigilent的文件夹拷贝到D:\Xilinx\14.2\ISE_DS\ISE\

zynq系列通过XMD进行JTAG调试出错解决方案

开发环境：ubuntu13.10   芯片类型：<em>zynq</em> zc7020,7015  JTAG cable 驱动安装，由于安装驱动过程中是使用root权限，该驱动的使用默认也必须是root权限。 测试驱动安装成功方法：以root权限打开vivado，在Program and debug中选择->handware maneger-> open target  按不着操作完后如果

FPGA的JTAG下载的错误

(一)检查是否安装驱动。 (二)下载器是否由红灯变成黄灯/绿灯。如红灯亮一般情况下，JTAG的与电路板VCC没有供电。 (三)检查JTAG连接的线序。 (四)检查JTAG电路，检查原理图上TMS，TDI，TDO的上拉和下拉电阻是否与datasheet中一致。

合理使用JTAG和IMPACT帮助你调试FPGA不能启动的问题

本来想着把GTX后面两篇博文找时间写了，但是最近实在是忙，一直在搭图像处理的AXI框架和整FPGA-DSP双平台的板子，下面先和大家分享一下调试心得。 最近调试一块新的Artix7板子，遇到了一个很奇怪的问题，问题是FPGA使用JTAG口能把程序到FPGA,FPGA也能跑得动，当配置模式选择MASTER SPI时，通过JTAG口下载也可以下载成功，但是问题是重新上电发现FPGA无法读出F

关于Xilinx FPGA JTAG下载时菊花链路中的芯片数量

关于Xilinx FPGA JTAG下载时菊花链路中的芯片数量 发布时间：2014-08-13 14:55:35  技术类别：CPLD/FPGA         当一个系统中含有多片（2片以上）Xilinx FPGA、CPLD或PROM（FLASH）时，可采用单一JTAG口以菊花链（Daisy C

Xilinx_Zynq_QSPI启动的编译、烧写、及配置过程步骤

Xilinx_Zynq_QSPI启动的编译、烧写、及配置过程步骤   一、 交叉编译器： 使用xilinx提供的编译器arm-xilinx-linux-gnueabi- Version 4.6.1版本。 1. 添加交叉编译器的环境变量： 打开~/.bashrc文件，在最后添加两行（按实际情况添加具体路径） export PATH=$PATH:~/xillinx/xilinx/CodeS

"30年---我与赛灵思FPGA的故事”：ZYNQ-7000使用总结(7) ——ZYNQ的启动和配置

由 allan 于 星期一, 06/30/2014 - 15:29 发表 前面在生成从Flash和SD卡启动的镜像文件时有提到一个FSBL，这个和ZYNQ的启动有关系。今天我就介绍一下ZYNQ的启动和配置。因为ZYNQ SoC由PS和PL部分组成，所以它的启动和配置也会稍微复杂一点，这里仅作简单介绍，希望可以起到抛砖引玉的效果。要了解具体的细节可以参考Xilinx官方文档UG585

使用Altera综合工具Quartus II下载到FPGA时无法识别USB-Blaster问题

问题描述：当使用Quartus II综合好的文件下载到FPGA时发现，没有识别到下载接口USB_Blaster,如下图所示。 图片中高亮的部分只有显示No Hardware,并没有显示我们需要的USB-Blaster[USB-0]（上面截图显示出来USB-Blaster[USB-0]是因为这张图是我解决这个问题后截取的），那么遇到这种情况该如何解决呢？ 解决方法：   首先检查你得设备...

Zynq器件XADC模块介绍

1．前言 赛灵思的7系列FPGA和Zynq器件创造性地在片上集成了模数转换器和相关的片上传感器（内置温度传感器和功耗传感器），这是相比赛灵思前一代产品来新增加的特性，可在系统设计中免去外置的ADC器件，有力地提高了系统的集成度。本文就这一新模块的使用进行简单介绍，希望对大家有所帮助，当然如有不当之处还请高手指正，以免误导大家，欢迎大家补充。 2．XADC模块介绍

zynq的三种启动方式(JTAG,SD,QSPI)

本文介绍<em>zynq</em>上三种方式启动文件的生成和注意事项，包括只用片上RAM（OCM）和使用DDR3两种情况 JTAG方式JTAG方式是调试中最常用的方式，在SDK中 在“Project Explorer”窗口工程上右键->Debug As->Debug Configurations可以看到以下窗口首次打开左边窗口中Xilinx C/C++ application(GDB)下没有子项，这时双击Xilinx

Zynq7020 uart以及Jtag的配置问题

拿到开发板之后uart一直无法连接，我的电脑为win10的系统，通过查阅文档，是需要安装CP210x USB to UART Bridge VCP Drivers 下载链接 有32位和64位可供选择 有关于Jtag口的刚开始无法连接到pc上，刚开始还以为是没安装驱动的缘故，后来查看手册后发现是在两个个播码开关上的配置忘记配置了 SW10圈出来的对应板子上的Jtag口，根据自己的需求来改...

FPGA的调试-内嵌逻辑分析仪(SignalTap)（二）实例

对于FPGA调试，主要以Intel FPGA为例，在win10 Quartus ii 17.0环境下进行仿真和调试，开发板类型EP4CE15F17。主要包括一下几个部分： - FPGA的调试-虚拟JTAG（Virtual JTAG） - FPGA的调试-在线存储器内容编辑工具(In-system Memory Content Editor) - FPGA的调试-内嵌逻辑分析仪(S...

用JTAG将mcs文件烧写到flash中

在ISE或EDK下生成BIT文件，可通过IMPACT对FPGA进行配制， bit文件是配制到FPGA内部RAM的，掉电就没有了， 如果需要固化到片外FLASH里面（下载到FLash或EEPROM），则需要将BIT文件转化为mcs文件，通过IMPACT固化到指定的ROM中。   假设已经生成了BIT文件，下面我们来介绍如何进行配制和固化，软件使用的是IMPACT12.2。 一、BIT文件下

ZYNQ启动

当一个Linux 系统上电或重启时发生的第一件事情，是处理器要执行在某个预 定的位置上的代码。(固化代码，存于内部ROM中？)对于桌面计算机，这个位置是位于主板上的闪存中的，这部分 闪存里的是基本输入/ 输出系统（Basic Input/Output System，BIOS）。因为现代 的PC 提供了如此多种多样的启动设备，BIOS 要做的第一件事情是判断从哪个设备 来启动[1]。 一旦

基于FPGA的在线升级的验证以及实现

      在线升级指的是程序不通过JTAG，仅仅是上位机发数据给<em>fpga</em>，<em>fpga</em>在将数据写到flash, 断电上电后，程序自动加载到<em>fpga</em>中，相当于仅仅通过一个接口（网口，usb接口或者串口），更新了<em>fpga</em>中的程序，对于一款成熟的产品，在线升级功能是必须的。下面将通过验证和实现两个方面分别介绍。   1， 在线升级的验证。          数据的大致流向是：  串口调试助手通过串口发...

ZYNQ跑系统系列（一） 传统方式移植linux

更多精彩内容，请微信搜索“FPGAer俱乐部”关注我们。           移植linux之传统方式 在ZYNQ开发时，有些情况下，为了降低开发的复杂性，或是提升系统运行的性能，在ARM上跑一个linux系统往往是一个不错的选择，而且linux系统一般集成了一些常用的成熟驱动，可以减少开发周期。本章将通过传统u-boot、kernel方式，完成移植。该方式虽然繁琐复杂，但是毕竟是一种

xlinx芯片JTAG烧录

在刚拿到xlinx芯片时，需要对其进行烧录，相对较麻烦，故在有linux系统时，用flashcp命令进行擦写。 下面介绍JTAG烧录操作的步骤（解决的大致步骤是，先将制作的BOOT.bin保存在DDR的一个位置，然后烧录u-boot系统，通过u-boot系统将BOOT.bin镜像烧录进去。）1 打开控制台在xlinx sdk下打开XMD控制台。 2 连接arm核在xmd控制台输入命令：conne

固化程序后识别不到FPGA设备

固化程序之后，以内部固化程序启动时，要拔出JTAG。 避免启动时因识别JTAG而延迟固化程序的加载，出现&quot;no programmable&quot;现象或扫描不到FPGA设备的现象。 若已拔出JTAG仍出现这些现象，经过软复位后现象消失，可将配置频率调高。 Vivado : Tools -&amp;gt; Edit Device Properties -&amp;gt; Configuration -&amp;gt; Con...

FPGA供电电压和JTAG引脚定义

JTAG（Joint Test Action Group ）：联合测试工作组 主要引脚： TMS：模式选择，5脚 TCK：时钟，1脚 TDI：数据输入，9脚 TDO：数据输出：3脚 4脚：接3.3V FPGA的供电含义： VREF：参考电压。 VCC_PLL：锁相环管脚电压，直接连VCCIO。 VCCA_PLL：锁相环模拟电压，一般通过滤波器接到VCCINT上。 GN

FPGA下载方式AS.PS,JTAG对比

**SOF文件通过JTAG下载可直接运行。重新上电后程序丢失。 SOF文件可以先转换jic,再通过JTAG下载，重新上电后程序正常运行。 POF文件通过AS模式下载后，重新上电运行。**AS模式(active serial configuration mode):主动配置方式：FPGA器件每次上电时，作为控制器从配置器件EPCS主动发出读取数据信号，从而把EPCS的数据读入FPGA中，实现对FP

FPGA笔记 AS和JTAG下载方式区别

AS模式，上位机通过JTAG口向FPGA烧写flash loader可执行代码到RAM，编程代码也下载到RAM,上位机发送命令给flash loader再将编程代码挪到flash中 JTAG模式，上位机直接将代码下到FPGA里的SRAM

"30年---我与赛灵思FPGA的故事”：ZYNQ-7000使用总结(2)——PS部分的使用

由 allan 于 星期四, 06/19/2014 - 17:31 发表 ZYNQ-7000包括PS和PL两部分，其中你可以只使用PS部分，而不用PL部分，这样可以认为你在单纯的使用一个ARM Cortex A9 MPore芯片。更多的情况下，我们会将PS和PL部分联合使用，不然也就失去了使用ZYNQ芯片的意义。但是，为了更好的理解和学习ZYNQ，我们先讲一个只使用PS部分的例子，这

FPGA中AS和JTAG接口的使用

FPGA中AS和JTAG接口的使用，从百度文库上下载下来的

FPGA的调试-虚拟JTAG

对于FPGA调试，主要以Intel FPGA为例，在win10 Quartus ii 17.0环境下进行仿真和调试，开发板类型EP4CE15F17。主要包括一下几个部分： - FPGA的调试-虚拟JTAG（Virtual JTAG） - FPGA的调试-在线存储器内容编辑工具(In-system Memory Content Editor) - FPGA的调试-内嵌逻辑分析仪(SignalT...

FPGA的JTAG口的保护问题？

引子 无论是客户反馈，还是自己亲身经历，USB-Blaster不能下载配置FPGA的情况时有出现。究其原因，大致有如下几条： 1. FPGA器件上的JTAG相关引脚出现故障； 2. USB-Blaster坏了； 3. 10针JTAG线缆没有压制好。 其中第1条给我们带来的损害最为严重，那么应该怎样规避呢？ 内容 故障1的现象 JTAG接口的TCK、T

JTAG原理+JTAG烧写FPGA配置芯片

JTAG原理： JTAG是目前ARM、DSP、FPGA常用的调试接口。在这些常用器件内部都集成了JTAG控制逻辑——TAP控制器，TAP控制器通过对边界扫描单元BSC的读写监测和控制ARM、DSP、FPGA的状态。简单的并口JTAG仿真器只是使用计算机并口+HC244（三态缓冲器）搭成，而Altera的USB Blaster比较复杂，包含了逻辑分析仪功能。 JTAG烧写FPGA配置芯片

ZYNQ无法烧录

1、如下图所示，是因为FPGA执行全局复位，需要先烧录FPGA解全局复位。

【教程】赛灵斯ZYNQ(Standanloe)创建uboot并烧写到FLASH

《赛灵斯ZYNQ创建uboot并烧写到FLASH》 第一步：创建第一级启动引导程序FSBL 第二步：创建UBOOT 将第一步生成的bootloader.elf文件拷贝到HelloWorld工程中。 创建BOOT 在HelloWorld工程下新建一个文件夹bootimage，方便管理,再将bootloader.elf移动到这个文件夹中 ...

Zynq7020 生成fsbl文件和bit文件

查询了Xilinx的数据手册，我们需要6个文件来进行，分别是：bit文件，dtb文件，fsbl文件，uboot文件，uImage文件，文件系统镜像文件。但是我在最后还差bit和fsbl这两个文件，不知如何生成，最终咨询了他们的FAE，这里记录一下。 首先是bit文件，其实bit文件就是需要在<em>fpga</em>的硬件工程文件编译一下才能生成，刚开始我以为他会自动生成，晕死。 至于fsbl文件，这个也不...

Zedboard 评测（一）——Demo演示

Zedboard是第一款面向开源社区的Zynq-7000系列开发板，而Zynq-7000系列FPGA，也称为完全可编程（All Programable）SoC，是Xilinx一个有重大意义的产品系列。 在FPGA里集成高性能的处理器内核一直是众多FPGA厂商以及客户的需求，Zynq-7000的面世标志着Xilinx在SoC集成度上的一个突破，实现了双核Cortex-A9 MPcore和最新的28

Altera的FPGA的AS、PS和Jtag配置模式的区别

有些人对于FPGA下JTAG的下载方式有些迷惑，为什么出现配置芯片了，为什么要用不同的下载电缆，不同的下载模式?通过在网上查阅相关资料做了总结和整理如下：  1 FPGA器件有三类配置下载方式：主动配置方式（AS）和被动配置方式（PS）和最常用的(JTAG)配置方式。 AS模式(active serial configuration mode):FPGA器件每次上电时作为控制器，由FPGA器件

JTAG MASTER GUI 可直接读写FPGA寄存器

福利！         之前有写过一篇关于JTAG Master工具的使用文档，但是tcl复杂的命令让很多不熟悉tcl初学者感到困难。 这里使用tcl脚本做了一个调试界面。即使对tcl一点都不了解，也可以通过该界面方便的进行FPGA寄存器的调试。 由于CSDN博客不太方便上传附件，这里直接贴源码。大家把代码保存后，另存为mem_test.tcl文件即可。 使

Zynq片内XADC应用笔记

Zynq片内XADC应用笔记 Hello，panda 应用笔记简要描述Xilinx Zynq XADC的相关资源及若干种应用。参考文档： u    ug480：7Series_XADC.pdf； u    xapp795：driving-xadc.pdf u    xapp554：xadc-layout-guidelines.pdf u    xapp1203：post-proc-ip...

xilinx zynq 7000 FSBL启动分析（二）

前言 在上一次分析中，分析到了 HandoffAddress = LoadBootImage(); 在分析这个函数之前，在从0地址运行之前，在复位（上电复位）之后会从bootROM这个位置开始执行代码，在bootROM中，程序会将QSPI（如果是从qspi启动的话）的前nK的数据拷贝到OCM中，然后跳转到OCM中执行。把生成的BOOT.bin文件用二进制程序打开，根据数据手册可以分析一下...

CPLD和FPGA中不同电压的JTAG电路设计注意事项

在初次的cpld电路设计的时候，遇到了这样的一个问题，整个系统是3.3V的系统，选用的cpld是XC9536-10VQ44C，芯片供电电压5V。他的io可以配置成3.3V和5V两种形式，因此，选用的时候，io口配置成了3.3V如下图，问题就有了，那在设计<em>jtag</em>的时候，上拉电阻应该上拉到那个电压呢？实验证明，<em>jtag</em>应该上拉到与io口相同的电平上。而上拉到供电电压的现象并不是损坏芯片，而是导致不能

zynq的启动方式学习

Zynq-7000AP SOC器件有效利用了片上CPU来帮忙配置。在没有外部JTAG的情况下，处理系统（PS）与可编程逻辑（PL）都必须依靠PS来完成芯片的初始化配置。 ZYNQ的两种启动模式：从BootROM主动启动，从JTAG被动启动。 ZYNQ的启动配置分多级进行的。配置至少需要两步，但通常按如下三个阶段进行： 阶段0：该阶段简称为BootROM，控制着整个芯片的初始化过程。放在Boot

Zynq-Linux移植学习笔记之19-启动加载与固化

1、  启动加载 启动时候自动执行shell脚本 Mount ramdisk，修改rootfs里面rcs文件   在RCS中添加代码 echo "++ Starting telnet daemon" telnetd -l /bin/sh   echo "++ Starting http daemon" httpd -h /var/www   echo "++ St

彻底掌握Quartus——虚拟JTAG篇

Altera的FPGA支持多种调试工具，其中最为大家所熟知的是Signaltap，虽然Signaltap支持条件触发、保存波形等强大的功能，但是，它也只能看个波形而已啊。 如果我要跟FPGA内部的逻辑交换数据，是否有个简便的方法？ 有的，它就是虚拟JTAG，它可以在线地把FPGA内部的数据写入或读取，这样，在调整算法参数（如PID的参数整定）的时候，无需多次综合。 推荐《虚拟JTAG教学视频

zynq7启动方式

一直对ZYNQ7的启动方式不是很明白，只知道有flash、SD、JTAG三种主流的启动方式，然而对这三种启动方式的启动过程以及所需要的文件对不是特别清楚。现在对SD卡启动和flash启动有了一些了解，结合自己的情况，做一下记录。 一、SD卡 需要的文件： 1、用官方套件即petalinux和SDK开发移植的Linux系统。需要以下几个文件即可启动： BOOT.BIN、image.ub、sy...

Altera与Xilinx FPGA同在一个JTAG链中的配置方法

Altera与Xilinx FPGA同在一个JTAG链中的配置方法作者：北京中芯优电信息技术有限公司    高级工程师   冯影秋因为Altera与Xilinx两家FPGA绝大部分FPGA都符合JTAG标准，所以可以在同一个JTAG链中进行配置。（这里需确认具体的器件型号序列支持JTAG标准）这里仅仅说明在QuartusII中对Altera的FPGA进行配置步骤。（本地下载与远

04-ZYNQ学习之FPGA+Linux开发的流程

通过前面3节内容，我们知道了： Xilinx ZYNQ的内部结构 PL端FPGA的开发过程 ZYNQ启动过程及固化  那么ZYNQ包含CortexTM-A9核，那么它的ARM资源应用主要就落在嵌入式linux上。ZYNQ的嵌入式Linux开发流程是本节介绍的重点。 一、嵌入式linux开发三要点 嵌入式linux底层开发主要工作是： bootloader 内核 文件系统 内...

四、使用SDk对ZYNQ调试

上一节把生成的Bitstream导入到SDk后，单击启动SDK。打开后如图将PC与Zedboard相连，接成调试模式，选择Xilinx Tools -> Program FPGA 命令，将比特文件下载到Zedboard。 在工程管理面板右键所创建的工程，选择Debug As -> Launch on Hardware 命令。单击yes进入调试界面。图中的调试界面其实和之前熟悉的keil之类的单片机

EP4CE6E22C8N FPGA的JTAG接口无法下载程序的问题解决

使用环境(蓝色粗体字为特别注意内容) 1、软件环境：Win7 32 bit，Quartus II。 2、硬件环境：EP4CE6E22C8N开发板 3、参考文献：1、https://zhidao.baidu.com/question/935982928989745212.html?qbl=relate_question_1&amp;amp;word=<em>fpga</em>%20<em>jtag</em>%20incorrect%20c...

ZYNQ USB SD驱动问题总结

当插入USB时，会出现以下问题：由于插入USB，出现的问题，首先排查USB驱动。经排查USB，无任何异常。经分析，1.首先我利用<em>zynq</em> 带的迷你型的文件系统uramdisk.image.gz，启动起来，因为此文件系统全部加载到内存里面运行，启动起来之后，将SD拔出。此后问题没有出现。可能问题出现的SD卡的布线上。当通信频率比较高时，有可能会造成SD通信出现错误。剩下 就只能交给硬件工程师来处理了...

zynq FPGA学习杂谈记录

1. 关于XADC <em>zynq</em>及7系列FPGA均包含一个XADC硬核模块，含2个12-bit 1MSPS A/D，这东西可以不例化就能正常工作，但若想通过FPGA逻辑访问状态寄存器，则必须例化 2. Build-in FIFO 注意：对于CoreGen FIFO生成器生成的异步时钟FIFO，在仿真时不要给同源时钟，否则写数据时会多写1个数 7系列 1块RAMB36的构成为：R

PC至FPGA的通信方式选取——Virtual JTAG

近几日都在学习PC和FPGA的通信。选择Virtual JTAG的原因是因为其符合我的硬件资源，而不是因为高效或者低成本。 由于自己之前毫无做过硬件接口的经历，所以这次的通信方式选择完全就是一个无厘头。下面是之前的通信方式选择结果。 rs232通信方式 1、即时在开发板上有MAX232电平转换芯片，但是 2、我没有USB-RS232的线，无法通信。 USB

Zynq动态更新FPGA比特流

ZYNQ-7000的结构是ARM+FPGA，在脱离JTAG的情况下，PL的配置只能通过PS来完成。正常上电的加载顺序是，FLASH/SD - > FSBL -> PL BITSTREAM -> PS ELF，那么在整个系统全部加载完成以后是否有办法重新给PL配置程序呢？答案是肯定的。 XILINX官方的BSP裸机例程里有xdevcfg的驱动代码，里面有个例程叫做POLL_EXAMPLE，就是实现

xilinx生成mcs，下载flash问题解决方法

大多数<em>fpga</em>初学者，在下载flash的时候，往往不加bitstream约束，无法下载flash，可能有的不需要加，就可以下载，这里给大家 简单介绍一下SPI和BPI flash的约束，以下作为设计参考，不同的板子不同的约束。 1.SPI flash约束 这里spi flash约束是针对博兰锐思主板M7的N25Q128A13BSF40E SPI flash进行的约束 set_prope

JTAG口不要热插拔

问题是：能否允许加电情况下插拔Jtag电缆接口，对单板编程。   回复如下：   任何一家PLD器件，包括Lattice和其对手器件，甚至包括其它使用Jtag加载的器件（如CPU等），都不支持加电情况下热插拔Jtag编程电缆，这样做很容易对器件造成损坏，原因如下： 1. 在插拔Jtag电缆接口时，不论单排或双排电缆接口，一般都没有特殊的保护装置可以保证每次插上电缆的时候是GND先接入，拔

jtag菊花链拓扑

关于XilinxFPGA JTAG下载时菊花链路中的芯片数量 当一个系统中含有多片（2片以上）XilinxFPGA、CPLD或PROM（FLASH）时，可采用单一JTAG口以菊花链（Daisy Chain）形式将所有芯片串联起来实现下载编程，如下图所示。这样做有两个好处：（1）可以节省多个JTAG口所占用的PCB空间，特别适合空间有限的嵌入式系统，如小型工业摄像机等；（2）嵌入式系统处于封闭环境

zedboard QSPI烧写LINUX系统的方法

转自：http://www.cnblogs.com/milinker/p/6484562.html QSPI烧写LINUX系统 3.1概述 3.2搭建硬件系统 本章硬件工程还是使用《S04_CH01_搭建工程移植LINUX/测试EMMC/VGA》所搭建的VIVADO工程。 3.3修改内核文件 Step1:切换到管理员模式 Step2:切换到scri

JTAG的TCK和GND短路补救方法

上百度搜索，有人说这样可以 JTAG已死，没事烧纸：：：：：： 焚~~~ 超生方法（实验一次没成功，但是好多人都说成功过，坏了不妨一试）： Cyclone III的JTAG死而复生 经过durgy指点，我让ep3c40f484c8的<em>jtag</em>死而复生了，这里写一下过程好让后继者迅速超生。 1、检查确认是否是<em>jtag</em>的引脚在芯片内部短路了，具体方法自己发

quartus 无法识别usb blaster确实帮了我大忙

一、Windows无法正常驱动USB-Blaster 解决办法：自行手动安装驱动， 参考文章：http://blog.csdn.NET/chengbozhe/article/details/47335391 不再赘述。 二、Quartus<em>无法识别</em>USB-Blaster 解决办法：Step1：检查任务管理器是否出现 <em>jtag</em>server.exe，如果没有，则： 右键我的电脑->管理-

Xilinx zynq系列FPGA实现神经网络中相关资源评估

目录 <em>zynq</em>7000系列概览 1.内存占用 1.1 FPGA程序中内存的实现方式 1.2  <em>zynq</em>的BRAM内存大小 1.3.一个卷积操作占用的内存 2. PipeCNN可实现性 PipeCNN论文解析：用OpenCL实现FPGA上的大型卷积网络加速 2.1 已实现的PipeCNN资源消耗 3. 实现大型神经网络的方法 4. Virtex-7高端FPGA概览  7系列FP...

xilinx FPGA 配置原理

任合芯片、处理器，只有将程序烧录进去才会正常工作，FPGA也不例外，只不过我们通常称之为“配置”，不同的下载方式就有不同的对应的配置模式。     从不同的角度分析，可以得到不同的划分形式，如从主从关系上分，则有主模式、从模式。如果从一次传输数据的位宽上分析，则有串行模式、和并行模式。（另外还有JTAG模式），模式的选择是由FPGA上的M0、M1、M2完成。因此，可以组合出多种不同的模式，如主串

初学Zynq与Vivado之总结

更多精彩内容，请微信搜索“FPGAer俱乐部”关注我们。一，Vivado在讲Zynq之前，需要先讲Vivado Vivado是Xilinx公司的一款EDA，2012年出第一版，现在已经成为Xilinx官方指定的开发软件了。 而ISE，呵呵哒的ISE，早在2013年就停止更新，被它的Xilinx粑粑抛弃了。 所以，在2013年及之后生产的板子和芯片，都不要用ISE开发。 虽然在ISE的新建工...

zedboard--zynq使用自带外设IP让ARM PS访问FPGA（八）

参考超群天晴的博客http://www.cnblogs.com/surpassal/，使用XPS为PS 处理系统 添加额外的IP。从IP Catalog 标签添加GPIO，并与ZedBoard板子上的8个LED灯相连。当系统建立完后，产生bitstream，并对外设进行测试。以后还有一个很重要的自定义用户Ipcore设计，下个实验来做下这个（一开始以简单的led和sw为例）。这个实验就使用呢自带外

zynq学习之启动与配置

一、Zynq的启动过程简介1、<em>zynq</em>有两种启动模式：从BootROM主动启动，从JTAG被动启动（1）从JTAG被动启动：通过 JTAG 先下载 bit 流文件，再下载 elf 文件，之后点击Run As 来运行的程序。JTAG 的方法是通过 TCL 脚本来初始化 PS，然后用 JTAG 收发信息，可用于在线调试。但是这样只要一断电，程序就丢失了。还得全部重新来过。（2）从BootROM主动启动...

Zynq 开发板FPGA比特流文件下载方式

Zynq开发板FPGA比特流文件可以通过三种途径下载： 1. 利用SDK生成的FSBL.elf文件自动加载FPGA比特流配置文件，将比特流文件，FSBL.elf文件和u-boot.elf文件利用SDK工具生成BOOT.BIN文件。 2. 利用u-boot下面的命令方式下载：1><em>fpga</em> info 0查看FPGA信息： 2>fatload mmc 0 0x1000000 design_

一定要正确拔插JTAG下载线

突然发现FPGA在JTAG和AS模式下都无法下载了，错误提示找不到器件，一检查，JTAG的TCK和AS模式下的DCLK都跟GND短路了，那个郁闷啊，一块FPGA就这么完了，仔细想想，估计肯定是这两天没有按顺序拔插JTAG下载线，都是带电情况下随意拔插的，导致两个脚被击穿了。谨记啊！ 附网友提供的正确拔插顺序： 推荐插拔顺序 插线顺序 1. 关闭FPGA开发板的电源； 2.

谈谈对zynq的浅显理解

<em>zynq</em>并不能说是一个嵌入arm核的FPGA。从它的启动过程就可以发现，绝对是arm主导的，所以称它为以高性能FPGA为外设的双核arm或许更为合适。以下是优势：第一个：开发环境的大集成。从hls到vivado到sdk，对于一个不熟悉FPGA的嵌入式软件工程师来说，完全可以把它当做简单的双核ARM，使用例程中搭建好的硬件环境，在sdk中开发。软件调试后发现某些算法太慢，速度上不去，可以用hls把这...

zynq 加载bit方法总结

版权属于原作者，此处转载不涉及任何利益，仅供学习交流 原文地址：http://xilinx.eetop.cn/viewnews-1887 如何在Zynq-7000上烧写PL Image 在Zynq-7000上编程PL大致有3种方法： 1. 用FSBL，将bitstream集成到boot.bin中 2. 用U-BOOT命令 3. 在Linux下用xdevcfg驱动。  

记一次ZYNQ板卡无法启动问题的调试过程

1.现象 板卡上电无法从QSPI启动，板卡为调试板卡，没有复位系统，QSPI FLASH中已经烧写boot.bin,要成功启动，分为下面四个阶段，首先bootrom上电后会根据boot mode(由配置MIO的管脚电平组合决定，即跳线帽)，从对应的启动介质中读取镜像，读取开始的时候会先读取头部信息，如果成功则才会load启动代码，将fsbl读到ocm运行，然后由fsbl去启动uboot。 ...

SylixOS下基于Zynq-7000加载FPGA程序

1、概述 本文主要介绍SylixOS下基于Zynq-7000平台加载FPGA程序的方法，该方法使用的是Zynq-7000的devcfg功能模块（Device Configuration Interface），该模块支持系统启动后进行FPGA程序的在线加载。 2、使用方法介绍 2.1 工程所在目录 devcfg驱动模块及应用程序位于本地git仓库中，暂不提供源码，如有需要可自行移植...

FPGA程序烧写方式——AS PS JTAG

FPGA器件有三类配置下载方式：     1：主动配置方式（AS）     2：被动配置方式（PS）     3：最常用的JTAG方式     AS模式（active serial configuration mode): FPGA每次上电时作为控制器，由FPGA器件引导配置操作过程，它控制着外部存储器和初始化过程，向配置器件主动发出读取数据信号，从而把EPCS**的数据读入FPGA中，实现对FP...

zynq 程序跑飞原因分析

<em>zynq</em> 程序跑飞原因分析

ZYNQ的中断（一）

1.ARM中断体系 中断的意思就不多说了。主要说明几个知识点： （1）ARM体系中，在存储地址的低位，固化了一个32字节的硬件中断向量表。 （2）异常中断发生时，程序计数器PC所指的位置不同，异常中断就不同。中断结束后，中断不同，返回地址也不同。但是，对于系统复位中断，不需要返回，因为整个应用系统就是从复位中断中开始的。 数据访问终止：数据访问的地址不存在，或者当前地址不允许访问。 ...

fpga用10脚jtag口原理图

altium用<em>fpga</em> 10脚<em>jtag</em>口原理图

Zedboard & Zynq 图像采集 视频开发 (二) FPGA图像采集raw转rgb888

前一篇已经介绍了Zedboard上面搭建图像采集系统的硬件结构，这一篇主要介绍Zynq内部Fpga部分系统设计下面是在本工程的系统框图图像采集OV7725是一款CMOS图像传感器，VGA分辨率，帧率60fps，SCCB协议，与I2C协议通用。这里用HDL编写一个I2C 模块，对ov7725进行初始化，i2c模块是直接采用的crazybingo的设计，这里不再赘述，只是列出ov7725寄存器初始化列...

XILINX FPGA功能引脚综述

XILINX FPGA功能引脚 引脚分类 备注 PS IO ARM(PS端)的专用引脚，主要是各种控制器和GPIO Select IO FPGA（PL端）引脚 Configuration Pins In Bank 0 Jtag类引脚（加载烧录） GTx Pins 高速串行收发器引脚 XADC Pins FPGA内部嵌入的ADC引脚 GTx Xilinx FP...

xilinx 不能自动安装USB 驱动

大部分情况下可以自动安装驱动，但有的不可以就

ZYNQ+Vivado2015.2系列（八）ARM+FPGA的优势，PS控制PL产生需要的PWM波（基于AXI总线）

上一节我们观察了AXI总线的信号，了解了基于AXI总线读写的时序，这一节我们继续探索基于AXI总线的设计，来看一看ZYNQ系列开发板的独特优势，PS可以控制PL产生定制化的行为，而不需要去动硬件代码。 这次实验是产生频率和占空比可调的PWM（Pulse Width Modulation）信号，调用8次，产生8路PWM波，并用这些信号去控制8路LED灯，观察实验效果。后面会做一个比较。 用的板子

ZYNQ XC7Z020移植到XC7Z030问题汇总

1、SD卡启动加载文件系统失败问题 现象： Waiting for root device /dev/mmcblk0p2... mmc0: new high speed SDHC card at address b368 mmcblk0: mmc0:b368 00000 7.51 GiB (ro)  mmcblk0: p1 p2 p3 VFS: Cannot open root dev

XILINX-zynq-7000-Z系列FPGA选型指南

XILINX-<em>zynq</em>-7000-Z系列FPGA选型指南

"30年---我与赛灵思FPGA的故事”: ZYNQ-7000使用总结(1)——概述

由 allan 于 星期四, 06/19/2014 - 17:03 发表 因为马上要离职的原因，需要将一些东西整理一下做交接。就将Xilinx ZYNQ-7000的使用经验做一下总结，希望对刚接触的人有一点帮助。需要说明的是，在接触到ZYNQ-7000之前，我并没有做过FPGA的设计，这一部分的基础可以说是零。而这一年的工作重心也并不是FPGA设计，所以这一系列文章的重点是工具的使用

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