Vivado Hls C/RTL Cosimulation一直在begin...

qq_36986887 2018-12-18 11:16:54
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fly 100% 2018-12-21
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对比altera赛灵思一致都没能解决软件问题 ，也就重新安装试试了
Vivado HLS C/RTL 联合仿真时间
简单的led.cpp,led.h,还有一个test bench文件xxxx.cpp。大概花了二十分钟,后面讨论时间慢的原因.
【FPGA】 HLS教程之C/RTL Cosimulation
翻译自xilinx官方教程ug902，p181
Vitis HLS C/RTL Cosim 报错 “Failed to compile generated C file xsim.dir/diamond/obj/xsim_2.c。”
Vitis HLS C/RTL Cosim 报错 “Failed to compile generated C file sim.dir/diamond/obj/xsim_2.c。”
vivado HLS入门流程
参照博客1和博客2（最下面）走了一遍，遇到问题注释一下，以便他人节省时间。 问题描述：生成波形文件无法打开。 解决： 1、在HLS界面设置博客中所说   Solution > Run C/RTL Cosimulation，仿真完成后，需要在Vivado下查看仿真结果。 注意：Dump Trace选项要选择all，否则不会产生波形数据，位置如下图所示。 2、vivado界面TCI...
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