建议在博客mark down编辑器中加入Verilog语言和VHDL语言的代码高亮

bt_ 2019-01-03 08:47:01

如题
近期在写硬件开发相关的博客时发现没有Verilog的代码高亮，有感而发
如果能加上就太好了

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fish-man 2019-01-03

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您好，非常感谢您的反馈，我会记录并提交此宝贵的建议

本部分课程中的C语言内容属于朱老师嵌入式Linux核心课程的第四... Verilog语言基础篇按需扩展，后面如果有补充录制会加到本课程目录中，如果有需要学习Verilog请直接学习本课程的【第3部分：Verilog HDL入门】

这两种语言都是用于数字电路系统设计的硬件描述语言，而且都已经是IEEE的标准。 VHDL1987年成为标准，而Verilog是1995年才成为标准的。这是因为VHDL是美国军方组织开发的，而Verilog是由一个公司的私有财产转化而来...

有时，同一个设计中即需要使用Verilog语言，又需要使用VHDL语言。由于一些原因，一个设计团队可能在做下一个项目时切换到使用另一种语言，但是会复用现有的一些功能模块。现有的这些功能模块经常是用不同语言编写的...

当前比较流行的硬件设计语言有两种，即 VHDL 与 Verilog HDL，两者各有优劣，也各有相当多的拥护者。

如果你搜索Verilog和VHDL的区别，你会看到很多讨论这场HDL语言战争的区别页面，但大多数都很简短，没有很好地举例说明，不方便初学者或学生理解。Verilog和VHDL之间的区别将在...

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