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VHDL程序实例集.7z下载
weixin_39822095
2019-05-12 12:00:16
VHDL程序实例集.7z
VHDL程序实例集.7z
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基础 学习笔记
最近一直忙着学校里的活动,所以没怎么更新,上周活动忙完了,正好也借着数电实验的机会,重新学习一下
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的编程。以下是转自360doc的教程: —————————————————————————————————————————————————————————————————————————— (本学习以MAXPLUS10为工具软件) 第一章、
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Quartus-II 全加器的设计 全加器可以由两个半加器和一个或门连接而成,这样得到的半加器电路称为顶层文件。 设计原理图如下: 下面全加器的设计采用层次结构的
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设计方法,采用元件例化语句。 工程文件名与顶层文件(全加器)文件名一样; 把全加器、半加器、或门的
vhdl
文件都要包含到工程中; 在全加器文件中声明半加器、或门为元件; 然后例化三个元件:两个半加器和一个或门。 建立工程:...
[
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] 案例模板——就算忘了也要把知识塞入大脑
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代码。 简单还是复杂,这要看受众了。文章目标人群就是忘了或者完全的不会的人,让你马上可以使用起来
VHDL
。这个语言我并不喜欢,太死板了。在了解Verilog前我还对Verilog有所期望,但是那个语言的设计也是一坨屎。设计一些非人 性的东西,考虑了特别多的问题但是语言变得很难用。 简短了解一下 注释 --和lua和SQL一样。用两个连续的减号
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的基本结构 完整的
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合(Package)和库(Library)五部分。其中,实体是用来描述设计系统的外部接口;构造体用于描述系统内部的结构和行为;包
集
合存放共享的数据类型、常数和子
程序
等;配置用于从库中选取所需单元来组成系统设计的不同版本;库存放已经编译的实体、构造体、包
集
合和配置。 1.1 实体 实体 .................................
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