求助大神：编程模拟实现一个基本5级MIPS流水线

手指舞蹈 2019-05-24 11:08:33

模拟器实现可以参考 SimpleScala Gem5 GPGPU-Sim
1.实现包括LOAD、STORE、BEQZ、任意一种寄存器-寄存器ALU指令、任意一种寄存器立即数ALU指令5种类型指令的指令。
2.运行程序，输入为自定义的一段运行需要停顿的输入程序，输出为流水线的时空图和程序的运行结果。

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寧辥 2019-06-02

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要疯了，根本不会

密码学不会 2019-05-31

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兄嘚，吉大计算机的吧

翻斗花园图图胡 2019-05-26

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系统结构吗同学，吉大17的？

MIPS Assembler and Runtime Simulator（MIPS汇编程序和运行时模拟器）

Verilog实现IMPS的5级流水线cpu设计本篇文章是在功能上实现cpu设计，而非结构上实现。结构上实现可以跳转到（此为个人推荐）： Verilog流水线CPU设计（超详细）此外有与本文章配套的资源，文章中不懂的地方可以跳转到： IMPS五级流水线cpu的制作一、实验内容 1.1：实验目的（1）CPU各主要功能部件的实现（2）CPU的封装（3）了解提高CPU性能的方法（4）掌...

一、流水线CPU 流水线CPU就是指将一条分解为多步，在同一周期内进行多条指令的同时执行。MIPS五级流水线就是将指令分为：取指(IF)，译码(ID)，执行(EX)，访存(MEM)，写回(WB)五个阶段。举个例子：比如第二条指令lui $t2,0x2100 在流水线CPU中执行的就是可以看到在200-300ns的周期里，IF阶段取到0x00400004处的指令，300-400ns，这条指令到了ID阶段，而IF阶段执行下一条指令。400-500ns，执行这条指令，ALU的结果为0x2100

MIPS多周期流水线化处理器实现(5级流水的MIPS架构的CPU设计) 一：MIPS架构是什么？当前CPU的两大架构是CISC（复杂指令集）和RISC（精简指令集） RISC：精简指令集处理器，Reduced Instruction Set Computer （ RISC结构简单，选取了使用频率高的简单指令，指令长度固定，多为单周期指令在功耗、体积、价格等方面有很大优势，多用于嵌入式领域） MIPS架构：是一种采取精简指令集（RISC）的处理器架构二：原理图 5个流水段分别为 IF(取指)，ID（译码）

(本文为一个期末考试题，文中的图部分摘引自（美）David.patterson ＜＜计算机结构与组成＞＞一书第一章 32 位单周期RISC处理器设计要设计一款处理器，首先要选择体系结构，本题选择的是RISC体系结构，因为它适合于流水线设计。然后需要选择一个标准的指令集，本题选择的MIPS指令集并按照常规的五段流水的方式来实现流水线。流水线的实现过程将在第二章介绍。 1.1目标

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