vivado中进行FPGA验证时的Timing一直显示警告，需要设置吗

wangjuxiang1996 2019-06-04 09:57:36
现在验证已经通过综合和编译，但是Timing一栏中总显示no input delay和no output delay，我需要去设置这些延迟吗，不设置的话对验证有影响吗？如下图
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