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Verilog计数器不按照always的要求计数怎么办
白衣仗剑饮清酒
2019-06-05 10:25:32
我想让计数器在上面的波形每个上升沿到来的时候计数,结果他不按照这个要求自己就开始计数了 是怎么回事
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Verilog计数器不按照always的要求计数怎么办
我想让计数器在上面的波形每个上升沿到来的时候计数,结果他不按照这个要求自己就开始计数了 是怎么回事
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fly 100%
2019-06-06
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时序图标一下信号名啊,time1 的信号 rst_n
白衣仗剑饮清酒
2019-06-05
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always @(posedge ro6 or negedge rst_n) begin if(!rst_n) cnt6 <= 32'b0; else if(time1 == 6'b0) cnt6 <= 32'b0; else cnt6 <= cnt6 + 1; end
白衣仗剑饮清酒
2019-06-05
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白衣仗剑饮清酒
2019-06-05
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