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SOPC系统设计入门教程下载
weixin_39821526
2019-07-21 08:00:27
SOPC系统设计入门教程
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SOPC系统设计入门教程
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S
OPC
系统
设计
入门教程
S
OPC
,
系统
设计
入门教程
前言 目录 第一章 概述 1.1 S
OPC
的概念 1.2 S
OPC
系统
设计
流程 1.2.1 S
OPC
Builder 的
设计
流程 1.2.2 S
OPC
Builder 的
设计
阶段 1.2.3 S
OPC
系统
开发流程 1.3 S
OPC
系统
开发环境 1.4 本书中的
系统
配置 第二章 S
OPC
系统
构架 2. 1
系统
模块框图 2. 2 Nios CPU 2.2.1 指令总线主端口 2.2.2 数据总线主端口 2.2.3 缓冲存储器 2.2.4 移位单元 2.2.5 乘法支持 2.2.6 中断支持 2.2.7 Nios 片上调试模块 2.2.8 开发环境 2. 3 Avalon 总线 2.3.1 基本概念 2.3.2 Avalon 总线传输 2.3.3 Avalon 三态接口 2.3.4 地址对齐 2. 4 外设 IP 模块 2.4.1 通用异步串行接口(UART) 2.4.2 可编程并行输入/输出模块(PIO) 2.4.3 定时器 2.4.4 DMA 控制器 第三章
系统
硬件开发 3.1 硬件开发流程 3.2 创建 Quartus II 工程 3.3 创建 Nios
系统
模块 3.3.1 开始使用 S
OPC
Builder 3.3.2
系统
频率 3.3.3 添加 CPU 和外设模块 3.3.4 指定基地址 3.3.5 生成
系统
模块 3.3.6 添加符号到 BDF 中 3.4 编译
设计
(Compilation) 3.5 编程(Programming) 3.5.1 配置 FPGA 3.5.2 用户微控制器 3.5.3 在 Nios
系统
上运行软件 3.6
下载
设计
到 Flash 存储器 第四章
系统
软件开发 4.1 软件开发流程 4.2 软件开发环境 4.3 文件
系统
4.4 软件开发工具 4.4.1 GNUPro 工具 4.4.2 Nios OCI 调试模块 4.4.3 Nios OCI 调试控制台 4.4.4 Nios SDK Shell 4.5 可配置的处理器硬件属性 4.5.1 乘法器 4.5.2 数据和指令高速缓冲器 4.5.3 用户指令 4.5.4 同时执行的多主(Multi-Master)总线结构和 DMA 4.5.5 数据和指令高速缓冲器 4.5.6 外设和存储器接口 4.6 Nios SDK 4.6.1 inc 目录 4.6.2 lib 目录 4.6.3 src 目录 4.7 软件开发应用 4.7.1 开始前的准备 4.7.2 打开 Nios SDK Shell 4.7.3 编译程序 4.7.4 用 insight
下载
、运行和调试程序 4.7.5 用 Nios OCI 调制控制台
下载
、运行和调试程序 4.7.6 重建(rebuild)软件 4.7.7
下载
软件到 Flash 4.7.8 第三方开发和调试工具 4.8 使用.hexout 4.9 其它的开发板通信和调试方法 4.9.1 GERMS 监视器 4.9.2 Insight:GNU 调试器 4.9.3 Gprof:GNU Profiler 4.10 Nios SDK Shell 提示信息 4.11 在 Nios
系统
中实现中断服务程序(ISR) 4.12 用户自定义指令 4.12.1 用户自定义指令的概念 4.12.2 加速效果 4.12.3 用户自定义指令应用 第五章
系统
模拟与调试 5.1 软件配置 5.2 模拟设置 5.2.1 存储器初始化 5.2.2 UART 外设模拟设置 5.2.3 S
OPC
Builder 模拟设置 5.2.4 通用
系统
模拟文件 5.3 ModelSim 模拟 5.4 模拟结果分析 5.4.1 通过 UART 外设同 GERMS 监控程序交互 5.4.2 执行 PIO 外设操作的 C 程序 5.5 增加/删除波形图信号 5.6 片外存储器模拟 5.6.1 使用自动产生的存储器模块 5.6.2 指定一个定制模块 5.6.3 定义存储器模块内容 5.7 调试 5.7.1 使用 SignalTap II 逻辑分析器 5.7.2 使用 SignalProbe 5.7.3 使用 Chip Editor 第六章
系统
设计
实例 6.1 建立硬件需求 6.2 创建一个基本的 Nios
设计
6.3 GDB 调试 6.4 添加用户外设 6.5 RTL 仿真 6.6 Flash 编程 6.7 用户指令和 DMA 6.8 MP3 播放器 附录 1:Nios 嵌入式处理器 32 位指令集 附录 2:Nios 嵌入式处理器开发板-APEX 20K200E 附录 3:Nios 嵌入式处理器开发板-Cyclone_1C20 附录 4:Nios 嵌入式处理器开发板-Stratix_1S10 附录 5:Nios 嵌入式处理器开发板-Stratix_1S40
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技术的全面介绍,针对ALTERA公司的FPGA来介绍此项技术,内容全面,介绍了
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的开发流程,外设,和总线结构等多方面的内容。
邵舒渊等编S
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邵舒渊等编S
OPC
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入门教程
Nios II 的boot过程要经历两个过程。 1. FPGA器件本身的配置过程。FPGA器件在外部配置控制器或自身携带的配置控制器的控制下 配置FPGA的内部逻辑。 如果内部逻辑中使用了Nios II, 则配置完成的FPGA中包含有 Nios II软核CPU。 2. Nios II本身的引导过程。一旦FPGA配置成功后,Nios II 就被逻辑中的复位电路复位,从re set地址开始执行代码。Nios II 的reset地址可以在S
OPC
builder的“Nios II More‘CPU’setting”页表 中设置。
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