zhengqijun_的留言板

[zhengqijun_]

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[wwoli]

你好，我想问一下，我的这个作业和您之前写的Quartus-II 全加法器这篇博文是类似的吗？ 我的作业是这样子的： FPGA与硬件描述语言CH2_ HW01 目标: 请利用port...map与for...generate叙述来完成两个8位元数字的相加 步骤 首先设计全加法器 ，并命名 为FA.vhd，其输入埠为A、 B、Ci，输出埠为S与Co。 ➢紧接著设计主程式，并命名为ADDER8.vhd，同时利用 port..map与for..generate叙述来完成两个8位元数字的相加。