如何调整倍频？求教，急！

lqdream 2004-09-14 10:38:40

主板是威盛694XL的，好像很老的板子，cpu是赛扬1.2
我不知道如何调整主板的倍频才行，我不知道主板的外频是多少也不知道在哪调，在网上找了好久关于这个主板的资料也没有找到，真郁闷，请教各位朋友帮帮我，急死我了

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lqdream 2004-09-16

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是威盛694XL ver2.0的

夜鹰 2004-09-14

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最好能确定一下板子的牌子和型号。

show1097336 2004-09-14

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买台新的吧。。。

本期课程主要讲述S5PV210的时钟系统，通过8节课的讲解和实战，希望大家能够彻底掌握S5PV210（以及类似复杂度的SoC）的时钟体系结构，理解MUX开关、DIV分频器、PLL倍频锁相工作电路等在时钟设置中的作用。

PLL(Phase locked loop，即锁相环)是最常用的IP核之一，其性能强大，可以对输入到FPGA的时钟信号进行任意分频、倍频、相位调整、占空比调整，从而输出一个期望的时钟。 PLL的基本工作原理如下图所示整体为一个反馈系统，输出的信号会作为反馈信号参与到系统中。对上图解释说明： ①：输入的参考时钟ref_clk会与④输出时钟进行比较，若参考时钟频率等于比较时钟频率，则在①处会输出0 若参考时钟大于比较时钟的频率则会输出一个变大的成正比的信号若参考时钟小于比较时钟的频

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