工业信息物理系统测试验证平台ETest_CPS

m0_71057114 2022-10-26 15:11:11

1)产品简介

ETest_CPS是一款工业信息物理系统测试验证平台(Embedded System Test Studio for Cyber-Physical System,简称:ETest_CPS)。ETest_CPS由软件和硬件组成,软件采用ETest,硬件包括测试机柜、测试主机(含主控制器、PCI底板、总线接口板卡)、显示器、稳压电源等组成。

ETest_CPS采用PCI架构的工控计算机作为测试主机,可有效缓解数据I/O瓶颈,具有较高的可靠性和兼容性,结构紧凑、集成度好,有多种工业级板卡可供选择。ETest_CPS可广泛应用于工业控制、航空航天、武器装备、汽车电子、仪器仪表等各领域嵌入式系统的测试需求。

 

2)系统架构

ETest_CSP由软件ETest和硬件两部分组成,其中硬件包括机柜、稳压电源、测试主机、显示器等。测试主机采用PCI架构的工业控制计算机,包括工控机箱、主控制器板、PCI接口扩展底盘、PCI-CAN板、PCI-RS232/422/485接口板卡、PCI-1553B板卡、PCI-ARINC429板卡、AD/DA/DI/DO、继电器板卡等。

3)系统特点

  1. 采用1.6米32U机柜,整齐有序,防护性好,适应于实验室环境;
  2. 测试主机采用PCI架构的工控机,19" 4U机箱结构,主频3.6G的4核CPU,支持12个 PCI槽;
  3. 19寸上架工业液晶显示器,分辨率1280×1024
  4. RS232/422/485各8路,速率最高可达921.6kbps
  5. 2通道CAN,CAN控制器频率16MHz,波特率在5Kbps-1Mbps之间可选;
  6. 双通道多功能双冗余1553B,支持1M/2M/4Mbps及用户自定义波特率;
  7. 32通道12位AD,采样率100KS/s(单通道),量程档可程控;
  8. 4通道12位DA,输出精度0.2%FSR,可编程输出不同量程;
  9. 32通道DI/DO,高输出驱动能力。

 

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代码转载自:https://pan.quark.cn/s/a4b39357ea24 基于VHDL语言的24进制多功能数字钟 FPGA多功能数字钟设计 安装要求 本项目采用QuartusII9.0版本设计,非9.0版本打开可能会存在兼容性问题。 本项目选用FPGA器件为CycloneIII_EP3C40Q240C8 设计任务 设计一个24进制多功能数字电子钟,要求具备以下功能: (1)时钟显示:能够以十进制在7段数码管上显示“时”、“分”、“秒”、“十分之一秒”。 (2)校表功能:能够对时钟进行校正。 (3)启动/暂停功能:能够控制时钟的启动和暂停。 (4)一键清零功能:能够将时钟清零。 (5)整点报时功能:能够在整点时发出报时信号。 (6)闹钟功能:能够在设置的时间到达时发出闹钟信号。 顶层设计原理图如下: image 设计方案/设计原理及总体框图 设计实现思路: (1)计时功能。 计时功能主要由四个计数器模块共同构成,其中十分之一秒计时器为十进制计数、分,秒计时器为六十进制计数、小时计时器为二十四进制计数。 计时器之间采用进位信号进行串联。 (2)十进制7端数码管显示功能。 显示功能由译码器模块实现。 译码器模块的两个输入端分别为刷新端和数据端。 七个译码器的刷新端连接十分之一秒的周期脉冲信号。 而数据端连接计数器的输出端,用以将4位输出BCD码译码为7端数码管的七位显示信号。 (3)校表功能。 校表功能由二选一模块和校时模式选择器模块构成。 其中二选一模块用于连接下一级计时器模块的进位信号和手动按钮脉冲信号。 当控制信号为“0”时,二选一模块输出计时器模块的进位信号。 而当控制信号为“1”时,二选一模块输出手动按钮信号。 控制信号由校时模式选择器模块输出,校时模式选择器输出端连...

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