基于FPGA:电子钟的设计报告全文共10页,当前为第1页。基于FPGA:电子钟的设计报告全文共10页,当前为第1页。 基于FPGA:电子钟的设计报告全文共10页,当前为第1页。 基于FPGA:电子钟的设计报告全文共10页,当前为第1页。 电子钟的设计报告 姓 名: 基于FPGA:电子钟的设计报告全文共10页,当前为第2页。基于FPGA:电子钟的设计报告全文共10页,当前为第2页。 组 别: 基于FPGA:电子钟的设计报告全文共10页,当前为第2页。 基于FPGA:电子钟的设计报告全文共10页,当前为第2页。 专业班级: 目 录 目 录 1 一、数字钟的设计要求 2 二、顶层设计 2 三、模块 3 1.顶层模块 3 2.分频器模块 4 3.按键消抖模块 4 4.计时模块 5 5.显示模块 6 6.报时和闹钟模块 6 四、 系统调试及运行结果分析 7 1、硬件调试 7 2、软件调试 8 3、调试过程及结果 8 (1)显示模块调试 8 (2)时间系统模块调试 9 五、总结 9 基于FPGA:电子钟的设计报告全文共10页,当前为第3页。基于FPGA:电子钟的设计报告全文共10页,当前为第3页。一、数字钟的设计要求 基于FPGA:电子钟的设计报告全文共10页,当前为第3页。 基于FPGA:电子钟的设计报告全文共10页,当前为第3页。 设计一个具有时、分、秒计时第二电子钟电路,按24小时制记时。 要求: 1、准确计时,以数字形式显示时、分、秒的时间; 2、具有分、时校正功能,校正输入脉冲频率为1Hz; 3、具有仿广播电台整点报时的功能,即每逢59分51秒、53秒、55秒及57秒时,发出4声500Hz低音,在59分59秒时发出一声1kHz高音,它们的持续时间均为1秒。最后一声高音结束的时刻恰好为正点时刻。 4、具有定时闹钟功能,且最长闹铃时间为一分钟。要求可以任意设置闹钟的时、分;闹铃信号为500Hz和1kHz的方波信号,两种频率的信号交替输出,且均持续1S。设置一个停止闹铃控制键,可以停止输出闹铃信号。 二、顶层设计 采用自顶向下的设计方法,首先根据数字时钟的功能要求进行顶层设计和分析,用FPGA实现系统的计时、显示驱动、按键输入处理、仿广播电台整点报时的功能。根据实训平台的硬件资源情况,输入信号包括时钟输入和按键输入,其中系统时钟由实训平台核心板50MHz 晶振提供,拨码开关作为校时、闹钟时间设置和复位的信号输入,输出信号包括峰鸣器控制输出、8位动态数码管位选和段选控制输出。 数字电字时钟系统主要有分频器模块、按键消抖模块、计时模块、整点报时和闹铃模块和显示驱动模块构成。 基于FPGA:电子钟的设计报告全文共10页,当前为第4页。基于FPGA:电子钟的设计报告全文共10页,当前为第4页。三、模块 基于FPGA:电子钟的设计报告全文共10页,当前为第4页。 基于FPGA:电子钟的设计报告全文共10页,当前为第4页。 1.顶层模块 如下图所示。 基于FPGA:电子钟的设计报告全文共10页,当前为第5页。基于FPGA:电子钟的设计报告全文共10页,当前为第5页。2.分频器模块 基于FPGA:电子钟的设计报告全文共10页,当前为第5页。 基于FPGA:电子钟的设计报告全文共10页,当前为第5页。 分频器模块的主要功能是为其他模块提供时钟信号。 输入端口:50MHz的时钟信号; 输出端口:1Hz、500Hz和1kHz三种频率的时钟信号。 如下图所示。 3.按键消抖模块 作为机械开关的键盘,在按键操作时,机械触点的弹性及电压突跳等原因,在触点闭合或开启的瞬间会出现电压抖动,如下图所示。实际应用中如果不进行处理将会造成误触发。 按键去抖动关键在于提取稳定的低电平状态,滤除前沿、后沿抖动毛刷。对于一个按键信号,可以用一个脉冲对它进行采样。如果连续三采样为低电平,可基于FPGA:电子钟的设计报告全文共10页,当前为第6页。基于FPGA:电子钟的设计报告全文共10页,当前为第6页。以认为信号已经处于键稳定状态,这时输出一个低电平按键信号。继续采样的过程中如果不能满足连续三次采样为低,则认为键稳定状态结束,这时输出变为高电平。 基于FPGA:电子钟的设计报告全文共10页,当前为第6页。 基于FPGA:电子钟的设计报告全文共10页,当前为第6页。 按键消抖模块功能是消除校时按键的机械抖动。 输入端口:消抖时钟,按键K1,K2和K3; 输出端口:校时信号set_h,校分信号set_m,显示模式mode。 如下图所示。 4.计时模块 计时模块是数字钟的主体电路,包括正常计时、对时间进行校正、设置闹钟时间和判断闹铃等功能。 输出端口:clk_1Hz_in,秒计时脉冲输入; mode,校时和闹钟设置功能切换信号输入; set_h,set_m,校时和
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