如何根据LVDS的时序规格计算TTL的前肩后肩。

梦之路 2013-08-03 11:08:27

大家好, 如上图,这是一个LCD屏的lvds的时序规格,
如何根据这幅图来算出行的前肩,后肩,以及同步脉宽呢?
即如何确定下面三个值:
HBPD:行同步信号的后肩,单位为1VCLK的时间。
HFPD:行同步信号的前肩,单位为1VCLK的时间。
HSPW:行同步信号的脉宽,单位为1VCLK的时间。
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wyqghost 2014-06-27
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你好,我最近也在做这个,我看了帖子,但是还是不太明白,能不能以那个时序图为例做个例子呢?
梦之路 2013-08-08
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不错, 非常感谢xiaosan5871的详细耐心的解释。 这个技术坎已经过了, 平台210, 接lvds10。1寸屏。 LVDS的屏修改很简单: 1. 设置长宽 2. 设置行场的总和;(HFPD+HSW+HBPD 的和要等于Blank time。) 3. 极性没有关系。 4. 看一下cpu提供出来的点频是否与屏的参数一致(A8 根据MPLL分频的算法不会正好提供到需要的频率)。 保证前3点,基本上都ok, 另外我发现,如果用高分辨率的kernel烧写并驱动低分辨率的屏, 是可以显示的, 只是指显示一部分。
简单并快乐着 2013-08-05
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LVDS好像比较奇葩的,以前用过一个,随便改参数他居然都显示正常,如果是LCD或者VGA,改一下马上就显示有问题的。
简单并快乐着 2013-08-05
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引用 3 楼 swet1231 的回复:
是啊, 这是LVDS的时序要求, 只有effective time(有效时间), Blank time(屏蔽时间)。 我想HFPD+HSW+HBPD 的和要等于Blank time。 另外HS, VS 的极性也不大好确认。
这个极性一般不会导致不显示,一般会导致模糊或者 有一些细点,这样改一下就可以了。
简单并快乐着 2013-08-05
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引用 2 楼 xiaosan5871 的回复:
信息足够了。 但是你要看仔细了,Thb并不是行后肩,Tvb也不是场后肩。 手册解释的很清楚,是你的思维太固化了: Thb:hsync blanking time; Tvb:vsync blanking time; 对于你的cpu,你只需要如下设置就可以: 行前肩(thp) + 行后肩(thb) = 176; //这里随便写就好了,例如,thp = 80, thb = 96; 场前肩(tvp) + 场后肩(tvb) = 25; //例如,tvp = 12, tvb = 13; 对于同步头的宽度,tvpw/thpw,在保证数值大于2的情况下,随意设置就好了。
这里只有两个信息而已。 不过LVDS 的要求和一般LCD不一样,更加没有VGA的要求高,还有几个参数,VGA都是要一对一的。 楼主就照着楼上这样设置就可以了。 两个相加等于 那个数值就可以了。 LVDS 我没亲自调试过,VGA 这个是要求不止上面四个参数的,一般都有八个参数调整。
xiaosan5871 2013-08-05
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"我想HFPD+HSW+HBPD 的和要等于Blank time。" ->不对。但错在哪里,就要你去看手册了 “另外HS, VS 的极性也不大好确认。” ->手册也会说明,如果没有说明,只能说你看的不仔细。(记得不止有文字,还有图喔~)
梦之路 2013-08-05
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是啊, 这是LVDS的时序要求, 只有effective time(有效时间), Blank time(屏蔽时间)。 我想HFPD+HSW+HBPD 的和要等于Blank time。 另外HS, VS 的极性也不大好确认。
xiaosan5871 2013-08-05
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信息足够了。 但是你要看仔细了,Thb并不是行后肩,Tvb也不是场后肩。 手册解释的很清楚,是你的思维太固化了: Thb:hsync blanking time; Tvb:vsync blanking time; 对于你的cpu,你只需要如下设置就可以: 行前肩(thp) + 行后肩(thb) = 176; //这里随便写就好了,例如,thp = 80, thb = 96; 场前肩(tvp) + 场后肩(tvb) = 25; //例如,tvp = 12, tvb = 13; 对于同步头的宽度,tvpw/thpw,在保证数值大于2的情况下,随意设置就好了。
简单并快乐着 2013-08-05
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上面都给出你数字了,直接填写了,不过好像不完整啊 只有一个HBPD和VBPD
YuFS 2013-08-05
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xiaosan5871 2013-08-05
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另外,请问下,兄台用的哪款CPU?
xiaosan5871 2013-08-05
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LCD内部分为2个mode:DE/HVsync。 很显然,以你的贴图来看,这个LVDS屏,是DE mode的。 以你目前的情况来看: Hsync/Vsync的极性不需要设置。(反转/不反转,对显示都没有任何影响)
梦之路 2013-08-05
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引用 4 楼 xiaosan5871 的回复:
"我想HFPD+HSW+HBPD 的和要等于Blank time。"
->不对。但错在哪里,就要你去看手册了


“另外HS, VS 的极性也不大好确认。”
->手册也会说明,如果没有说明,只能说你看的不仔细。(记得不止有文字,还有图喔~)

1. 这个我的理解是总和, 至于您讲为什么不包括SW, 我在仔细看看。

2.
LVDS里面的时序图没有HS,VS的, 不过幸好, DE以及clock的极性能看出来,所以组合起来也就4中情况。大不了挨个试好了。下图附一个LVDS屏的时序图。

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