如何根据LVDS的时序规格计算TTL的前肩后肩。

2013-08-03 11:08:27 1.5k 阅读 AI 写同款 · GEO 优化AI 选题数据监测一键分发 ›

lvds屏幕的数据手册如何看一、前言1．LVDS输出接口概述　　液晶显示器驱动板输出的数字信号中，除了包括RGB数据信号外，还包括行同步、场同步、像素时钟等信号，其中像素时钟信号的最高频率可超过28MHz。采用TTL接口，数据传输速率不高，传输距离较短，且抗电磁干扰（EMI）能力也比较差，会对RGB数据造成一定的影响；另外，TTL多路数据信号采用排线的方式来传送，整个排线数量达几十路，不但连接不便，而且不适合超薄化的趋势。采用阅读详情

大家好，如上图，这是一个LCD屏的lvds的时序规格，
如何根据这幅图来算出行的前肩，后肩，以及同步脉宽呢？
即如何确定下面三个值：
HBPD：行同步信号的后肩，单位为1VCLK的时间。
HFPD：行同步信号的前肩，单位为1VCLK的时间。
HSPW：行同步信号的脉宽，单位为1VCLK的时间。

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LVDS、TTL、RSDS、TMDS接口原理与实战：液晶显示信号传输核心技术解析在数字电路与嵌入式系统中，信号传输技术是连接处理器与外围设备的关键桥梁。其核心原理在于通过电信号编码数据，并确保其在传输过程中的完整性、速度与抗干扰能力。从基础的单端并行传输到先进的差分串行通信，技术的演进旨在解决高速率、长距离下的信号衰减、电磁干扰（EMI）与功耗问题。这些技术为消费电子、工业控制及汽车电子等领域提供了稳定可靠的物理层解决方案，尤其在显示系统中，直接决定了图像质量、系统成本与可靠性。本文聚焦于液晶显示领域最常用的LVDS、TTL、RSDS、TMDS四种接口，深入剖析其电压摆幅、差分对设计、阅读详情

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切换为时间正序

wyqghost 2014-06-27

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你好，我最近也在做这个，我看了帖子，但是还是不太明白，能不能以那个时序图为例做个例子呢？

梦之路 2013-08-08

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不错，非常感谢xiaosan5871的详细耐心的解释。这个技术坎已经过了，平台210，接lvds10。1寸屏。 LVDS的屏修改很简单： 1. 设置长宽 2. 设置行场的总和；（HFPD+HSW+HBPD 的和要等于Blank time。） 3. 极性没有关系。 4. 看一下cpu提供出来的点频是否与屏的参数一致（A8 根据MPLL分频的算法不会正好提供到需要的频率）。保证前3点，基本上都ok，另外我发现，如果用高分辨率的kernel烧写并驱动低分辨率的屏，是可以显示的，只是指显示一部分。

简单并快乐着 2013-08-05

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LVDS好像比较奇葩的，以前用过一个，随便改参数他居然都显示正常，如果是LCD或者VGA，改一下马上就显示有问题的。

简单并快乐着 2013-08-05

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引用 3 楼 swet1231 的回复:

是啊，这是LVDS的时序要求，只有effective time（有效时间）， Blank time（屏蔽时间）。我想HFPD+HSW+HBPD 的和要等于Blank time。另外HS， VS 的极性也不大好确认。

这个极性一般不会导致不显示，一般会导致模糊或者有一些细点，这样改一下就可以了。

简单并快乐着 2013-08-05

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引用 2 楼 xiaosan5871 的回复:

信息足够了。但是你要看仔细了，Thb并不是行后肩，Tvb也不是场后肩。手册解释的很清楚，是你的思维太固化了： Thb：hsync blanking time； Tvb：vsync blanking time；对于你的cpu，你只需要如下设置就可以：行前肩（thp） + 行后肩（thb） = 176; //这里随便写就好了，例如，thp = 80， thb = 96；场前肩（tvp） + 场后肩（tvb） = 25； //例如，tvp = 12， tvb = 13；对于同步头的宽度，tvpw/thpw，在保证数值大于2的情况下，随意设置就好了。

这里只有两个信息而已。不过LVDS 的要求和一般LCD不一样，更加没有VGA的要求高，还有几个参数，VGA都是要一对一的。楼主就照着楼上这样设置就可以了。两个相加等于那个数值就可以了。 LVDS 我没亲自调试过，VGA 这个是要求不止上面四个参数的，一般都有八个参数调整。

xiaosan5871 2013-08-05

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"我想HFPD+HSW+HBPD 的和要等于Blank time。" ->不对。但错在哪里，就要你去看手册了 “另外HS， VS 的极性也不大好确认。” ->手册也会说明，如果没有说明，只能说你看的不仔细。（记得不止有文字，还有图喔～）

梦之路 2013-08-05

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是啊，这是LVDS的时序要求，只有effective time（有效时间）， Blank time（屏蔽时间）。我想HFPD+HSW+HBPD 的和要等于Blank time。另外HS， VS 的极性也不大好确认。

xiaosan5871 2013-08-05

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信息足够了。但是你要看仔细了，Thb并不是行后肩，Tvb也不是场后肩。手册解释的很清楚，是你的思维太固化了： Thb：hsync blanking time； Tvb：vsync blanking time；对于你的cpu，你只需要如下设置就可以：行前肩（thp） + 行后肩（thb） = 176; //这里随便写就好了，例如，thp = 80， thb = 96；场前肩（tvp） + 场后肩（tvb） = 25； //例如，tvp = 12， tvb = 13；对于同步头的宽度，tvpw/thpw，在保证数值大于2的情况下，随意设置就好了。

简单并快乐着 2013-08-05