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在vivado中ZYNQ zcu102的PCIe核怎么使用?(结合AXI总线与DDR之间实现数据传输)
weixin_38293307
2019-03-16 06:25:59
请问在Vivado中想使用ip核:DMA/Bridge Subsystem for PCI Express,我的板子是zynq UltraScale+MPSoC 的zcu102.
但是我没有找到这个ip核,请问怎么使用呀?或者能找到一个替代的吗?我需要使用这个与DDR传输数据,使用AXI总线。谢谢!标准图见下:
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在vivado中ZYNQ zcu102的PCIe核怎么使用?(结合AXI总线与DDR之间实现数据传输)
请问在Vivado中想使用ip核:DMA/Bridge Subsystem for PCI Express,我的板子是zynq UltraScale+MPSoC 的zcu102. 但是我没有找到这个ip核,请问怎么使用呀?或者能找到一个替代的吗?我需要使用这个与DDR传输数据,使用AXI总线。谢谢!标准图见下:
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qian_123456
2021-07-14
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ZCU102芯片内部没有PCIE核的
ZYNQ-ZCU102/4
2019-07-05
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https://blog.csdn.net/Newyan3651/article/details/92832320 ----这个不知道能不能帮到你,不过怎么用AXI交互好像文章里没写得很清楚
zcu102
试验
axi
timer
博客配套资源 https://blog.csdn.net/botao_li/article/details/86475467
zcu102
_
axi
_lite参考实验源码
博客配套工程源码 https://blog.csdn.net/botao_li/article/details/85630090
axi
_dma.rar
本文件
使用
ZCU102
开发板,基于
vivado
开发,
使用
axi
dma
实现
PL和Ps
之间
的通信。其
中
添加了FIFO,保证数据不丢失。
ug585-
Zynq
-7000-TRM.pdf
Xilinx官方提供
ZYNQ
7000的数据手册,详细介绍了
ZYNQ
各个模块,包括PS和PL部分,以及各个模块内部寄存器等信息
zynq
_0_CSDN.rar
基于
Zynq
UltraScale+
ZCU102
的基本程序,PL端流水灯。
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