在vivado中ZYNQ zcu102的PCIe核怎么使用？(结合AXI总线与DDR之间实现数据传输）

weixin_38293307 2019-03-16 06:25:59

请问在Vivado中想使用ip核：DMA/Bridge Subsystem for PCI Express，我的板子是zynq UltraScale+MPSoC 的zcu102.
但是我没有找到这个ip核，请问怎么使用呀？或者能找到一个替代的吗？我需要使用这个与DDR传输数据，使用AXI总线。谢谢！标准图见下：

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qian_123456 2021-07-14

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ZCU102芯片内部没有PCIE核的

ZYNQ－ZCU102/4 2019-07-05

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https://blog.csdn.net/Newyan3651/article/details/92832320 －－－－这个不知道能不能帮到你，不过怎么用AXI交互好像文章里没写得很清楚

博客配套资源 https://blog.csdn.net/botao_li/article/details/86475467

博客配套工程源码 https://blog.csdn.net/botao_li/article/details/85630090

Xilinx ZYNQ Ultrascale + ZCU102上的RISC-V火箭芯片关于这个仓库这是FPGA 上RISC-V的ZCU102端口。 ZCU102至少可以容纳四芯RISC-V核火箭芯片。该存储库的火箭芯片版本与原始存储库相同，该原始存储库在2018年4月。新的火箭芯片版本可以在主流火箭芯片。在ZCU102上，使用Vivado v2017.1进行单核配置的时钟频率（时钟速度）可以达到195 MHz。请参阅以了解如何使用此存储库。注意：我最近在删除了sed命令，因为它在主机OS环境中不可靠。而是，在第一次构建之前，只需在245行中插入新行|aarch \ 。关于SD卡（将硬件和软件堆栈带入FPGA），请参见。当前流已在以下主机环境中经过测试：软件版本作业系统 16.04.1-Ubuntu与4.15.0-64-generic内核重击 4.3.48

本文件使用ZCU102开发板，基于vivado开发，使用axi dma实现PL和Ps之间的通信。其中添加了FIFO，保证数据不丢失。

Xilinx官方提供ZYNQ7000的数据手册，详细介绍了ZYNQ各个模块，包括PS和PL部分，以及各个模块内部寄存器等信息

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