RISC-V迈入高性能,量产落地是关键
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RISC-V迈入高性能,量产落地是关键
这是最好的一届RISC-V中国峰会,虽已落幕一周,但它流传的故事依旧激昂人心,它引发的话题仍未褪色,它带来的启发依旧值得我们细细品味。
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赛昉科技重磅发布全新RISC-V处理器内核及多核子系统IP平台
8月17日,中国RISC-V软硬件生态领导者赛昉科技正式发布两款自主研发的高性能RISC-V处理器内核新产品:昉·天枢-90(Dubhe-90)与昉·天枢-80(Dubhe-80)。
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MyBatis入门到精通——Mybatis入门篇
一、什么是 MyBatis?MyBatis 是一款优秀的持久层框架,它支持自定义 SQL、存储过程以及高级映射。MyBatis 免除了几乎所有的 JDBC 代码以及设置参数和获取结果集的工作。MyBatis 可以通过简单的 XML 或注解来配置和映射原始类型、接口和 Java POJO(Plain Old Java Objects,普通老式 Java 对象)为数据库中的记录。二、入门案例(1)创建maven项目在此之前,需要提前配置好java环境变量和maven环境变量。..
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编写python代码估算sin(x)的值
请编写一个程序迭代求解sin(x),迭代公式为sin(x)=x/1-x^3!+x^5/5!-x^7/7!+...+(-1)^(2n-1)/(2n-1)!,当n项的值小于10^-5时结束,x为弧度。要求输入x的值,输出相应的结果。【注意】迭代公式中的^代表幂运算。并且输入和输出各占一行,输出结果保留4位小数;运行效果如下所示。【运行结果】输入(一行):1.57输出(一行):1.0000一、程序代码#!/usr/bin/python# -*- coding: UTF-8..
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花费600+小时,却上线了一个“不务正业”的功能,神马情况
花费600+小时,程序员福利网却上线了一个“不务正业”的功能,神马情况!一看便知
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RISC-V中国路演
RISC-V中国路演我们很高兴的公布11天内跨5个城市的RISC-V中国路演。RISC-V基金会将在中国举办一系列免费的RISC-V入门活动。这些为期一天的活动将展示基金会成员的创新RISC-V实施。深圳5月6日 May 6, 2019深圳富苑皇冠假日套房酒店成都5月8日 May 8, 2019成都天府丽都喜来登饭店杭州5月13日 May 13, 2019JW万豪酒...
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《手把手教你设计CPU——RISC-V处理器》读书笔记
文章目录关于书籍和胡振波关于RISC-V关于蜂鸟E200全书结构国产CPUCISC和RISC的区别RISC-V商业版本与开源版本配套源码配套开发板购买总结推荐阅读Stay Hungry, Stay foolish(求知若饥,虚心若愚)——Steven Jobs(史蒂夫-乔布斯)关于书籍和胡振波首先感谢面包板社区提供这本**《手把手教你设计CPU——RISC-V处理器篇》书籍的试读机会。这...
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RISC-V学习笔记【中断和异常】
RISC-V架构的中断与异常一般来说由处理器内部的事件或程序执行中的事件引起的程序跳转称为异常;一般的由处理器外部因素引起的程序跳转称为中断广义上来说中断和异常都被处理器视为异常,一般将其分为同步异常和异步异常同步异常同步异常:由于执行程序指令流或者试图执行程序指令流而造成的异常表现:CPU外部环境一定,多次执行时每次能够精确复现常见的同步异常包括但不限于:取指令访问到非法的地址区间读写数据访问地址属性出错取指令地址非对齐错误非法指令错误执行调试断点指令异步异常异步异常:产生原
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RISC-V ISA 命名规范
RISC-V ISA 命名规范RISC-V ISA 采用模块化的方式进行组织,每一个模块使用一个英文字母表示,其命名格式可以参考如下:RV[字宽][指令集模块]RV:RISC-V字宽(处理器寄存器的宽度):32位,64位,128位指令集模块:标识该处理器支持的指令集模块集合基本整数(Integer)指令集: RISC-V唯一强制要求实现的基础指令集,其他指令集都 是可选的扩展模块。扩展模块指令集: RISC-V允许在实现中以可选的形式实现其他 标准化和非标准化的指令集扩展。特定组合“IMA
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国产RISC-V开发板RV-STAR初体验
RV-STAR开发板初体验在芯来科技的公众号上看到,他们出了一块RISC-V的开发板,赶紧入手了一块,虽然武汉现在疫情很严重,但还是很快就收到了快递包裹,激动的想要看看这块板子怎么样。先来个正面特写吧,宝石绿的板面,板载两颗芯片,这也是很少见的了;整个板子周围布满了各种外设接口,非常有科技感。官方的文档说,它采用的是TYPEC的供电口,还可以用来下载程序。这个还蛮方便,我的小...
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早春营|RISC-V处理器嵌入式开发
培训主题RISC-V处理器嵌入式开发时间地点时间:3月1日起,每周周一、周四的13:30-14:30地点:网络授课面向人群:对RISC-V以及软件开发和CPU设计感兴趣的工程师、开发者、爱好者和学生课程表一共8节课,每节课45-60分钟主办方介绍芯来科技是中国领先的RISC-V处理器IP和芯片解决方案公司,凝聚了一支本土经验丰富的处理器研发团队。在短短2年多的时间内,从0开始全自主研发,相继推出了N100,N200,N300,N/NX/UX...
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RISC-V双周报1.12-1.26
RISC-V双周报汇总了国内外最近两周内RISC-V领域的大事小情,欢迎持续关注。RISC-V打开百度APP,查看更多高清图片新闻速递1月22日,平头哥半导体已经成功将Android 10(AOSP)移植到自己的RISC-V芯片——玄铁910上且平稳运行。通过对代码仓库的初步分析,平头哥半导体开源了除了底层驱动之外全部相关代码。平头哥基于安卓开源项目(AOSP)实现了RISC-V对Android的支持,主要体现在:本地库与ART、Linux内核和Build系统支持上。工作量非常大,是只有
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说说RISC-V的x0寄存器
RISC-V有32个通用寄存器,其中第1个寄存器x0硬编码为0,即读出来总是0,写进去总是被丢弃。x0为RISC-V指令集的简化可贡献不少啊。mingdu.zheng at gmail dot com http://blog.csdn.net/zoomdy/article/details/79343785搞过Linux的都知道Linux有两个特殊的设备:/dev/zero和/dev/nu...
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对RISC-V前途的一些看法
我是比较看好RISC-V的前途的,首先它出自大名鼎鼎的UC Berkeley;并且成立了RISC-V基金会,基金会成员中不乏高通这样的半导体公司和谷歌这样的软件公司;它采用了比较宽松的BSD授权方式,虽然其本身是开源的,但可应用于商业场合,这将受到商业公司的欢迎;最后SiFive公司已经有工程样品流片出来了,不再只停留在FPGA的层面上。mingdu.zheng at gmail dot co...
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RISC-V嵌入式开发准备篇2:嵌入式开发的特点介绍
本文的目的是对嵌入式开发的特点进行简单的科普与回顾,为后续详细介绍“RISC-V GCC工具链”和“RISC-V汇编语言程序设计”打下基础。
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优秀的 Verilog/FPGA开源项目介绍(二)-RISC-V
优秀的 Verilog/FPGA开源项目介绍(二)-RISC-V关于RISC-V的二三事risc-v官网❝https://riscv.org/RISC-V(跟我读:“risk-------...
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RISC-V Tools编译安装三部曲之一
超详细新手教程一、前言本文包含RISC-VGCC/Newlib Toolchain、GNUtoolchain for RISC-V, ISA Simulator等编译安装。笔者所用OS为:Ubuntu 14.04.5 LTS (GNU/Linux 4.4.0-31-generic x86_64)。本文参照RISC-V的官方文档结合自己机器的实际情况实验得出,文中难免有些纰漏,还请...
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RISC-V ELF规范和函数调用规范
原文出处:https://github.com/riscv/riscv-elf-psabi-doc/blob/master/riscv-elf.mdpsABI: Processor Specific Application Binary InterfaceRISC-V ELF psABI specificationTable of ContentsRegister Con...
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2021年集创赛“芯来RISC-V杯”等你来战!
2021年第五届全国大学生集成电路创新创业大赛(下称集创赛)正式开启报名通道!大赛由工信部人才交流中心主办,示范性微电子学院产学融合发展联盟,IEEE中国代表处,北京电子学会协办,北京智芯国信运营。集创赛是全国高校学科竞赛榜集成电路领域唯一入榜赛事,今年芯来科技首次作为杯赛赞助单位,参与命题并承办RISC-V专项赛事,赛题面向本硕博所有年级,期待您的参与!芯来科技将提供软硬件资源与配套教学资料,助力参赛者取得好成绩!RISC-V杯简介 ...
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