电源地和设备地连一起了造成USB信号不稳定,该怎么解决?
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电源地和设备地连一起了造成USB信号不稳定,该怎么解决?
提个问题: 背景描述:PCB上设备地和电源地连一起了,导致信号转接板输出USB信号,传输不稳定,经常连不上/断开。重新插拔或重启就又可以继续工作。 使用垫片和尼龙螺丝把设备外壳和PCB做物理隔离,有改善,但还是会偶尔掉一下。 再接上信号增强转接板,可
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怎么通过输入字母经过串口接收字母
怎么通过输入字母经过串口接收字母
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单片机供电电路设计问题点
如上图所示,单片机供电引脚,每个引脚分配一个100nf的去耦电容,CDEC为100nf,CBULK为4.7uF,为何部分端口有五个端口,而所绘制的图里面只有四个电容,而且一个是CBULK的大电容,还有就是,CBULK这个大电容放的位置应该放在这些P
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提问请教:单片机检测接近开关,请问再增加检测接近开关有没有脱落呢,硬件如何设计
1、左侧3P用于检测 接近开关 2、右侧T反馈给单片机 现在想增加一个功能,左侧插件脱落希望能检测到,不知道怎么做,请教下各位老友
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请问STM32如果接一个外置DAC并口硬件连接问题
请问STM32如果接一个外置DAC并口硬件连接问题,我知道SPI和iic接口硬件连接比较明了,但是并口有些糊涂,比如12位,有D0-D11,NAME D0-D11是随便接12个IO口,还是必须接比如FSMC的0-11口,或者是比如PA0-PA11,有
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擅长基于瑞芯微全系SoC做产品,寻软件开发搭档
精通瑞芯微全系SoC的硬件设计开发,包括原理图、PCB,但缺少软件开发人员。寻搭档。
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找个苏州的电子工程师师傅
有苏州、常熟的硬件工程师吗,想找个师傅教学,可以有偿,有的话还请联系下,本人电子信息工程毕业,感谢,
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verilog基础问题求助
编写16位*16位booth加法器,模拟时reset信号一置1(低位有效),输出就变红xxxx,折腾好久弄不明白原因在哪,求助大佬 图为模拟 代码如下 module booth_multiply( input clk, input reset, i
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雷击浪涌四级过不了,应该怎么设计
电源这样设计,在做浪涌3级时,TVS管被击穿导致短路,我是否要选着大点的保险丝还是
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为什么添加激励后波形变成了这样子?求解!
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2023广州交通设施展会
展会名称 2023粤港澳大湾区(广州)交通智能设施、养护工程新基建展览会 展会主题 科技创新赋能交通发展 时间和地点 时间:2023年8月24日~26日 地点:广州市广交会展馆D区 组织机构 指导单位: 广东省交通运输厅 主办单位: 广东省沥青混凝土
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J-Flash打不开已有的.jflash文件是什么原因,该怎么解决
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stm32 IIC 做从机,时钟信号出现阶梯
主机是一个测试设备,从机是stm32f103。这里只截取了主机读取从机的波形,在地址发送完之后,CLK线出现了一个小阶梯。在主机向从机写入的时候又是正常的,没有出现这个阶梯,有大佬知道是怎么回事吗。
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关于国产替代型号问题 求解答
请问是否有这个IC型号的国产替代品呀 瑞萨ISL80103
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关于压差的问题,求大神解答
这个LDO具有额外的电源PIN-CTRL 我们必须对 CTRL 引脚施加电压才能让这个IC正常运行。 我们只有一个电压源4.5V 如果我们从一个电源向IN PIN和CTRL PIN施加4.5V,Vdrop会有什么效果?电压必须从不同的源施加到IN和
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找不到win32aloem怎么办啊
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找不到win32aloem怎么办啊
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关于四路差动比较器LM339的输出一直是低电平的问题
如题,有一路同相端电压是大于反相端的,但输出一直是低电平,其它三路是正常的,上拉电阻是10k,有没有大佬知道为什么呢?
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RT thread stdio在导入keil5项目只能下载不能调试
直接导入的我keil项目。编译没有错误,也是标准例程,使用正点原子的DAP下载,但是点击调试时,出现上述错误。
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AD里修改封装原点,如何保持pcb里器件不变动
用ad软件的时候,我将一个器件封装的原点位置从1引脚改到了中心位置,结果更新后,pcb里面对应的器件位置也发生了变化。请问如果想仅改变封装的原点,而不变动该器件在pcb里的位置,需要怎么做?
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