各位佬好，我想问一下在网上找的解决方案可以点击Upgrade Selected(不是灰色)，但仍会报错是啥原因

在PL端使用DMA，只使能s2mm通道，设备树如下， &amba_pl { adcdma_fun_0: adcdma_fun0@0 { compatible = "adcdma_demo"; dmas = <&axi_dma_1 1>; dma-na

热烈庆祝“基于FPGA的嵌入式AI-深度学习模型部署”研修班2023.12.21-24日成功在京举办！《自然语言与语音处理设计开发工程师》2024年1月3日至7日-北京 《计算机视觉处理设计开发工程师》2024年1月24日至28日-北京

错误 （12002）：宏函数“inst1”中不存在端口“L_pulse” 错误 （12002）：宏函数“inst1”中不存在端口“R_pulse” 错误 （12002）：宏函数“inst1”中不存在端口“clk” 错误 （12002）：宏函数“ins

千万别局限在单一的信息渠道。

一个人可能走得更快，但一群人，才能走得更远

想知道怎么对bar空间进行数据写入，目前通过pio写入的值读到的数据不理想。如果有人可以解答或直接上手解决可以为知识付费

请问哪位大佬有opencores的账号借用一下，想下载一个IP但是账号注册的验证邮件一直没有

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本人最近在做导师的一个小任务，在使用FPGA开发时遇到了一个问题，想请各位大佬们帮忙看一下。 我的电路中有一个寄存器信号reg data_en_buff, 我希望该寄存器能对输入的信号data_en做一个时钟周期的延迟。当我令data_en在0和1之

嗨各位好，目前想做一個可動態調整CLK的PLL，經查詢官方文件: AN661 Implementing Fractional PLL Reconfiguration with Altera PLL and Altera PLL Reconfig IP

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求助大佬们，我用Kintex 7开发板使用ov5640摄像头采集图像，然后用HDMI接到显示屏，跑程序之后显示屏显示不支持输入，这个怎么解决啊，我是完全使用开发板提供的例程调试的，万分感激

VERILOG HDL

打开SDK 后SDK log 里面一直有Error:（XSDB Server )invalid command name while executing.然后SDK就没办法使用，关闭也关不了，请问怎么解决？

VHDL程序与硬件接口适配设计遇到的一个告警信息